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CY7C145
CY7C144
架构
该CY7C144 / 5由一个的8/9位8K字的数组
每个双端口RAM单元， I / O和地址线，并控制
信号（ CE ， OE ，R / W） 。这些控制引脚允许indepen-
凹痕的访问为读或写操作的任何位置在存储器中。对
处理同时写入/读出的同一个位置，一
BUSY引脚提供的每个端口上。两个中断（ INT ）引脚
可用于端口到端口的通信。两个sema-
phore （ SEM ）控制引脚用于分配共享重
源。通过M / S引脚，所述CY7C144 / 5可以用作
硕士（ BUSY引脚输出），或者作为一个奴隶（ BUSY引脚
为输入） 。该CY7C144 / 10具有自动断电
功能通过CE控制。每个端口具有其自己的
输出使能控制（OE ），它允许数据被读
从设备。
在主模式下的推挽输出，无需上拉起来再
电阻取值进行操作。
主/从
在M / S引脚是为了扩大通过配置字宽度设置
uring设备为主机或从机。繁忙的输出
在主站连接到从繁忙的输入。这将允许
该器件无需外部器件接口到主设备
从设备的nents.Writing必须延迟到以后的BUSY
输入已解决。否则，从器件芯片可以开始写周期
争期间situation.When提出了高投入，在M / S
引脚，该器件被用作一个主站和因此在BUSY
线是输出。然后，BUSY可以用于发送仲裁输出
走到一个奴隶。
信号量操作
该CY7C144 / 5提供八个锁存信号有哪些
从双端口存储器单元中分离出来。信号灯
用于保留那些在两者之间共享资源
该信号量的ports.The状态表示有一个资源是
在使用中。例如，如果左端口想要请求一个给定的
资源，它通过写0到一个信号位置设置一个闩锁。
左边的端口，然后验证其通过设置锁定成功
阅读它。写信号后，扫描电镜或OE必须
拉高对于T
SOP
之前试图读取信号。该
信号量的值将用T
SWRD
+ t
美国能源部
后的上升沿
的信号写入。如果左端口成功（读取0 ）时，它
假定在共享资源控制，否则（读出1）它
假设正确的端口具有控制和不断地轮询sema-
phore.When右侧已经放弃了对信号灯的控制
（写入1 ）中，左侧将获得的控制成功
信号量。如果左侧的不再需要的信号量， 1是
写到取消其请求。
信号灯被认定SEM LOW访问。扫描电镜
引脚作为片选信号量锁存器（ CE绝
留在SEM低高） 。一
0–2
代表信号灯
地址。 OE和读/写被用于以相同的方式作为一个正常的
内存access.When写入或读取的信号，其他AD-
装扮针没有效果。
当写入信号，只有I / O
0
被使用。如果把0写入
到一个未使用的信号量的左侧端口，一个1将出现在相同
信号处理正确的端口上。现在，信号量只能
由侧表示0（在这种情况下，左端口）进行修改。如果左
港口现在写1到该信号量放弃控制时，
信号将被设置为1的两侧。然而，如果有合适的端口
曾要求信号（写了一个0 ），而左口有
控制，正确的端口将立即拥有信号量，尽快
作为左口把它释放出来。
表3
样本显示信号能操作
ations 。
当读取一个信号，所有八个/ 9数据线输出
信号量的值。读值锁定在输出稳压
存器，以防止信号的过程中改变状态
从另一个端口写。如果两个端口尝试访问
T内信号量
SPS
对方，信号量肯定会
由一方或其它可以得到的，但也不能保证其
一边将控制信号。
信号量的初始化是不是自动的，必须
在上电时初始化程序复位。所有sema-
两侧phores应该有一个在写入到它们
从双方的初始化，以确保它们将是自由
在需要的时候。
功能说明
写操作
数据必须被设置为T的时间
SD
前上涨
读/写的，以保证有效的写入边缘。写OP-
关合作是任OE引脚（见写周期控制
第一波形）或R / W引脚（见写周期第2波
形式）。数据可以被写入到设备吨
HZOE
在OE后
被拉高或T
HZWE
后的R / W的下降沿。重
quired输入用于非竞争的操作总结
in
表1中。
如果一个位置被一个端口，另一写入
试图读取该位置端口，一个端口到端口的流出液
延迟之前必须满足的数据被读出到输出; oth-
erwise读取的数据是不确定的。数据将是有效的
港口吨
DDD
后的数据被呈现在其他端口上。
读操作
当读取装置，用户必须断言二者在OE
和CE引脚。数据将用T
ACE
CE或T后
美国能源部
后
OE断言。如果CY7C144 / 5意愿的用户AC-
塞斯一个信号标志，那么SEM引脚必须置
而不是CE引脚。
中断
中断标志位（ INT ）允许之间的通信
ports.When左端口写入位置1FFF ，正确的端口的接口
中断标志位（ INT
R
）被设置。当正确的端口读取该标志被清除
该相同的位置。设置左端口的中断标志位（ INT
L
）是accom-
plished在正确的端口写入位置1FFE 。该标志将被清除
当左端口读取位置1FFE 。在1FFF消息或
1FFE是用户定义的。看
表2
为INT输入的要求。
INT
R
和INT
L
为推挽输出，无需上拉电阻
器来操作。
忙
该CY7C144 / 5提供片上仲裁，以减轻simul-
taneous内存位置访问（争） 。如果两个端口“
CE都断言和地址匹配时T内
PS
每
其他的忙逻辑将决定哪个端口访问。如果T
PS
is
违反了，一个端口肯定会获得批准的位置，但它
不能保证哪一个。 BUSY将变吨
BLA
经过
地址匹配或T
BLC
经过CE为低电平。忙
L
和BUSY
R
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