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初步
引脚德网络nitions
（续）
引脚名称
CQ
I / O
回波时钟
引脚说明
CY7C1311BV18
CY7C1911BV18
CY7C1313BV18
CY7C1315BV18
CQ参照相对于℃。
这是一个自由运行的时钟和同步到
在QDR -II的输出时钟（ C） 。在单时钟模式下， CQ相对于K的生成
定时反馈时钟显示在AC时序表。
CQ参照相对于℃。
这是一个自由运行的时钟和同步到
在QDR -II的输出时钟（ C） 。在单时钟模式下， CQ相对于K的生成
定时反馈时钟显示在AC时序表。
输出阻抗匹配输入。
此输入用于调整器件输出至系统
数据总线阻抗。 CQ ，CQ，和Q
[x:0]
输出阻抗为0.2× RQ 。其中，RQ是
电阻ZQ与接地之间。另外，该引脚可直接连接到
V
DD
，这使得最小阻抗模式。此引脚不能直接连接到
GND或悬空。
DLL关闭 - 低电平有效。
此引脚连接到地将关闭该DLL在设备里。
在DLL中的定时关闭操作将与本数据表中列出的不同。
在此操作的更多细节可以在应用笔记中可以发现， “DLL运行于QDR -II ”。
TDO的JTAG 。
TCK引脚用于JTAG 。
TDI引脚用于JTAG 。
TMS引脚用于JTAG 。
未连接到模具上。
可连接到任何电压电平。
未连接到模具上。
可连接到任何电压电平。
未连接到模具上。
可连接到任何电压电平。
未连接到模具上。
可连接到任何电压电平。
未连接到模具上。
可连接到任何电压电平。
参考电压输入。
静态输入用于设置HSTL输入和输出的参考电平
以及交流测量点。
地面的装置。
CQ
回波时钟
ZQ
输入
DOFF
输入
TDO
TCK
TDI
TMS
NC
NC/36M
NC/72M
产量
输入
输入
输入
不适用
不适用
不适用
不适用
不适用
输入 -
参考
地
NC/144M
NC/288M
V
REF
V
DD
V
SS
V
DDQ
电源
电源输入到该装置的核心。
电源
电源输入，用于该装置的输出。
所有同步数据输入（D
[x:0]
）输入通过输入
寄存器通过输入时钟（ K和K）控制的。所有
同步数据输出（Q
[x:0]
）输出通过输出
通过输出时钟的上升沿控制寄存器（C
和C或K和K在单时钟模式下） 。
所有的同步控制（ RPS ， WPS ， BWS
[x:0]
）输入通
通过的上升沿控制的输入寄存器
输入时钟（K和K ） 。
CY7C1313BV18在下面的章节中描述。该
相同的基本描述适用于CY7C1311BV18 ，
CY7C1911BV18和CY7C1315BV18 。
读操作
该CY7C1313BV18内部组织为4阵列
256K X 18的访问都是一阵四个完成
连续的18位数据字。读出操作是通过启动
主张RPS活跃的正输入端的上升沿
时钟（ K） 。提交地址输入地址存储
在读地址寄存器。下面接下来的K时钟上升沿，
数据的对应最低阶18位的字被驱动
到Q
[17:0]
使用C作为输出定时基准。对
的C后续的上升沿下一个18位数据字被驱动
到Q
[17:0]
。这个过程继续，直到所有的四个18位的数据
第23页第7
功能概述
该CY7C1311BV18 ， CY7C1911BV18 ， CY7C1313BV18 ，
CY7C1315BV18是同步流水线突发SRAM的
配备有一个读端口和一个写端口。在读
端口专用于读操作，写端口是
专用于写操作。数据流入的SRAM
通过写入端口和通过所述读端口。这些
设备复用的地址输入端，以最小化
所需的地址引脚数量。通过具有独立的读
和写端口， QDR-II完全消除了需要
“掉头”的数据总线，并且避免任何可能的数据
争，从而简化了系统设计。每个访问
由4个8位的数据传输中的情况下
CY7C1311BV18 ，在的情况下为四个9位数据传输
CY7C1911BV18 ，在的情况下， 4个18位数据传输
CY7C1313BV18 ，并在的情况下， 4个36位数据
CY7C1315BV18转移在两个时钟周期。
访问两个端口上的积极投入发起
时钟（ K） 。所有的同步输入定时是从参考
的输入时钟（K和K）和所有输出的定时的上升沿
被引用到输出时钟（C和C或K和K时
在单时钟模式） 。
文件编号： 38-05620牧师**
