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CD54HC597 ， CD74HC597 ， CD74HCT597
工作原理图
DS
D0
D1
D2
并行
数据
输入
D3
D4
D5
D6
D7
ST
CP
SH
CP
PL
MR
15
1
2
3
8 F/F
存储
注册。
5
4
6
7
12
11
13
10
9
Q7
8-BIT
移
注册。
14
功能表
ST
CP
↑
↑
没有时钟边沿
X
SH
CP
X
X
X
X
PL
X
L
L
L
MR
X
H
H
L
功能
数据加载到输入触发器
从输入移位寄存器加载数据
从输入传输数据FL IP- FL OPS到移位寄存器
无效的逻辑状态转移的，注册的时候不定
信号中去除
移位寄存器清零
移位寄存器时钟控制尺寸Qn = QN- 1 ， Q0 = D
S
X
X
X
↑
H
H
L
H
H =高电平， L =低电压等级， X = Do not护理，
↑
=转型从低到高CP级别
2
