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莱迪思半导体公司
ORCA ORT42G5和ORT82G5数据表
图8.接收DEMUX模块的单SERDES通道
10-bit
SRBDxx [9：0 ]
p
q
r
s
t
x
y
z
延迟= 4 RSYS_CLK [ A1 ， ... ， B2 ] CLOCKS
RWD_XX [ 31:24]
RWBIT8_xx[3]
RWBIT9_xx[3]
RWD_XX [ 23:16]
RWBIT8_xx[2]
RWBIT9_xx[2]
RWD_XX [15：8 ]
RWBIT8_xx[1]
RWBIT9_xx[1]
RWD_XX [7 ：0]的
RWBIT8_xx[0]
RWBIT9_xx[0]
40-bit
p
p p
7-0 8 9
q
q q
8 9
t
t
t
7-0
8
9
7-0
x
7-0
x x
8 9
r
7-0
r
8
r
9
y
7-0
y y
8 9
z z
8 9
s
7-0
s s
8 9
z
7-0
每两个或四个通道的块中的一个时钟，称为RCK78 [A，B ] ，被发送到FPGA中。控制位RCKSEL [A ， B]
用于选择，它是源为这些时钟的通道。
链路状态机
两个链路状态机都包含在装置中，一个用于XAUI的应用程序和一个第二光纤信道应用程序
阳离子。
光纤通道链路状态机负责建立发射机和之间的有效链接
接收器和用于维持链路的同步。该机最初是在失去同步（ LOS ）
国家在上电复位。这是通过WDSYNC_xx = 0表示在此状态下，机器将查找partic-
连续的空闲ular数量之间的有序集合，没有任何无效的数据传输同步宣布之前
chronization实现。同步的实现是通过断言WDSYNC_xx = 1，具体来说指出，
整机看起来三个连续的空闲有序集合，没有任何错位逗号或任何正在运行的显示
基于校验码侵犯之间。在任何这样的代码违反的情况下，该机器将自动复位到
基态，并开始其搜索空闲再有序集合。实现链路的典型有效序列同步的
nization将K28.5 D21.4 D21.5 D21.5重复三次。
在同步完成状态，机器不断地监视接收到的数据，并寻找任何类型的
代码违反可能会导致由于运行不一致错误。如果是收到四个这样的连续无效
即，链路机失去其同步，并再次进入同步状态（LOS）的损失。一
对由所述设备接收到有效的话克服了以前遇到的码违例的效果。 LOS
由WDSYNC_xx输出的状态现在转变从1到0此时机器显示
试图再次建立链接。图9示出了用于光纤通道链路状态机的状态图。
LOS也由DEMUXWAS_xx状态寄存器的位表示。该位是同步丢失时设定为0 。
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