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TLV320AIC3101
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SLAS520C - 2007年2月 - 修订2007年7月
概述（续）
可编程偏移，在每个帧中的比特时钟在数据开始可以被改变，并且该串行数据
输出驱动器（ DOUT）也可以在所有的位时钟时除外编程为高阻抗状态
有效数据被放置到总线上。这允许其它的编解码器，以具有不同的偏移量，并且被编程
推动他们的数据到同一DOUT线，只是在不同的插槽。对于接收的数据，编解码器简单地忽略
除非预期总线上的数据的基础上，编程偏移。
注意，该数据的位置时的偏移被编程是不同的，这取决于传输模式是
选择。在DSP模式下，数据的左和右信道被传送立即彼此相邻
在框架中。这不同于左对齐模式，其中所述左和右信道数据总是一个半帧
除了在每一帧中。在这种情况下，由于偏移是从零编程为一些较大的值，这两个左和
在框架右声道数据移动，但仍然彼此留一个全半帧分开。这被描绘
in
图22
对于这两种情况。
DSP模式
字时钟
位时钟
IN / OUT数据
N–1 N–2
OFFSET
1
0
N–1 N–2
1
0
左声道数据
右声道数据
左对齐模式
字时钟
位时钟
IN / OUT数据
N–1 N–2
OFFSET
1
0
OFFSET
N–1 N–2
1
0
左声道数据
右声道数据
T0153-01
图22. DSP模式和左对齐模式，显示了
编程的数据字的偏移量的影响
音频数据转换
该TLV320AIC3101支持以下标准的音频采样率： 8千赫， 11.025千赫， 12千赫， 16千赫，
22.05千赫， 24千赫， 32千赫， 44.1千赫， 48千赫， 88.2千赫，和96千赫。该转换器也可以在操作
不同的采样率的各种组合，这将进一步描述如下。
该数据转换器是基于一个f的概念
S（ REF ）
率，用于内部的一部分，它是与
该转换器通过一系列传动比的实际采样率。对于典型的采样率，女
S（ REF ）
无论是
44.1 kHz或48 kHz的，虽然它实际上可以设置在更宽范围内的速率高达53千赫，用另外的
限制应用，如果使用了PLL 。这个概念被用来设置ADC和DAC的采样率，并
也使高品质的播放低采样率的数据，没有高频可闻噪声是
产生的。
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