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QPRO XQ4000XL QML系列高可靠性的FPGA
XQ4000XL引脚至引脚输出参数指南
切换参数进行测试后，测试是模仿
通过MIL - M-六百〇五分之三万八千五百十指定的方法。所有器件都
100％的功能测试。引脚到引脚的时序参数
从测量外部和内部测试图案衍生
并保证在最坏情况下的运行条件
（电源电压和结温） 。下面列出的是
对于典型的引脚位置和正常代表性的值
时钟负载。为更具体，更精确，并
最坏情况下保证数据反映实际的路由
结构，使用由静态时序模拟提供的值
仪（ TRCE在Xilinx开发系统）和
背注到仿真网表。这些路径延迟，
作为一个指导原则，已提取的静态
时序分析器报告。值表示在纳秒
哔声，除非另有说明。
输出触发器，时钟到输出
(1,2,3)
所有
民
1.5
2.0
2.3
2.5
3.0
-3
最大
8.6
9.8
11.3
-
3.0
-1
最大
-
-
-
9.5
3.0
单位
ns
ns
ns
ns
ns
符号
T
ICKOF
描述
使用关全局低偏移时钟输出
(4)
设备
XQ4013XL
XQ4036XL
XQ4062XL
XQ4085XL
T
慢
对于输出SLOW选项添加
所有器件
注意事项：
1，以上列出的是代表值，其中一个全局时钟输入驱动器在每个访问的列一个垂直时钟线和
其中所有可访问的IOB和CLB触发器的时钟由全局时钟网络。
2.时钟到了最小延迟测量以最快的路线和负载最轻，时钟到输出的最大延时使用测
最远的距离和IOB每一个时钟引脚（ IK或OK）的参考负载以及驱动所有可访问的CLB触发器。为
与时钟负载时，焊盘与IOB时钟引脚延迟由静态定时分析器（ TRCE ）确定的一个较小的数字设计的可
被添加到AC参数Tokpof和用作最坏情况管脚到管脚时钟到输出延迟为快速模式时钟输出
精读网络gurations 。
3.输出定时测量 50 ％V
CC
门槛为50 pF的外部容性负载。
4. OFF =输出触发器
输出触发器，时钟到输出， BUFGEs 1 ， 2 ， 5 ，和6
所有
民
1.3
1.2
1.2
1.3
-3
最大
7.4
8.1
9.9
-
-1
最大
-
-
-
8.5
单位
ns
ns
ns
ns
符号
T
ICKEOF
描述
使用关全局的早期时钟输出
值对于BUFGEs 1,2 ，5和6 。
设备
XQ4013XL
XQ4036XL
XQ4062XL
XQ4085XL
注意事项：
1.时钟到了最小延迟测量以最快的路线和负载最轻，时钟到输出的最大延时使用测
最远的距离和IOB每一个时钟引脚（ IK或OK）的参考负载以及驱动所有可访问的CLB触发器。为
与时钟负载时，焊盘与IOB时钟引脚延迟由静态定时分析器（ TRCE ）确定的一个较小的数字设计的可
被添加到AC参数Tokpof和用作最坏情况管脚到管脚时钟到输出延迟为快速模式时钟输出
精读网络gurations 。
2.输出定时测量 50 ％V
CC
门槛为50 pF的外部容性负载。
DS029 （ V1.3 ） 2000年6月25日
产品speci fi cation
www.xilinx.com
1-800-255-7778
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