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CYP15G0401DXB
CYV15G0401DXB
CYW15G0401DXB
当RFMODE = HIGH时，复用模式的多字节
成帧器功能。如赛普拉斯模式多字节成帧器，
多帧字符必须在之前被检测
字符边界被调整。在这种模式下，成帧器确实
不调整字符时钟的边界，而是对准
字符已经恢复的字符时钟。在这
模式中，数据流必须包含至少4的
所选帧字符，收到连续
人物，在相同的10位界限，之前的字符
成帧被调整。
取景所有通道启用时RFEN = HIGH 。如果
RFEN =低，成帧器每个通道被禁用。当
制宪者是残疾人，不进行任何更改到
回收的字符边界上的任一通道，无论
数据流中的帧字符的存在。
10B / 8B解码器模块
解码器逻辑块执行三个主要功能：
解码接收到的传输的字符回
数据和特殊字符代码
比较与接收产生BIST模式
字符允许在高速链路和设备测试
新一代的解码后的字符奇校验的。
10B / 8B解码器
每个解串器的框并行输出是
传递到10B / 8B解码器，其中，如果该解码器是
启用（ DECMODE
≠
低） ，它是由一个10位的转换
传输字符回原始数据和特殊
字符代码。该模块采用10B / 8B解码器
在模式
表28
和
表29
本数据手册。有效数据
字符由上一个为000b的比特组合指示的
相关RXSTx [2：0 ]状态位，以及特殊字符
代码显示了一个001B位组合在这些相同
状态输出。帧字符，无效的图案，差距
错误和同步状态显示为候补
这些状态位的组合。
该10B / 8B解码器工作在两种模式下正常，并能
也被绕过。对于解码器中的操作模式是
由DECMODE输入控制。
当DECMODE = LOW时，该解码器被旁路，生
10位字符被传递到输出寄存器。在这
模式下，信道绑定是不可能的，该接收弹性
缓冲器旁路， RXCKSEL必须的MID 。这个时钟
模式产生不同的RXCLKx ±输出为每个接收
通道。
当DECMODE = MID （或打开） ， 10位传输
字符都使用解码
表28
和
表29 。
收到特典人物所使用的解码
赛普拉斯列
表29 。
当DECMODE = HIGH ， 10位传输字符
利用解码
表28
和
表29 。
获得特别
码字符所使用的备用列解码
表29 。
如果解码器被启用的所有设置，接收路径
可被操作为单独的通道或结合形成
各种多通道总线。
接收BIST操作
接收器接口包含内部码型发生器
可用于验证两个装置和链接操作。
文件编号： 38-02002牧师* L
这些发电机都是由相关京东方启用[ X]
信号中列出
表10
（当BISTLE锁存使能输入
为高电平） 。当启用时，在相关的寄存器接收
信道变为图案发生器和校验器通过逻辑
转换为线性反馈移位寄存器（ LFSR） 。这
线性反馈移位寄存器生成一个511个字符的序列，其中包括所有
数据和特殊字符代码，其中包括明确
违反符号。这提供了一个可预测的但假
随机序列，该序列可以匹配到一个相同的LFSR
在所附的发射器（多个） 。如果接收通道是
配置为通用时钟操作（ RXCKSEL
≠
MID ）
每次通过前面有一个16个字符的字同步
序列。当与所接收的数据流同步，
相关的接收器会检查每个字符在
译码器与由线性反馈移位寄存器及生成的每个字符
表示在RXSTx比较差错和BIST状态[2：0 ]
输出寄存器的位。看
表24
了解详细信息。
当BISTLE信号为HIGH时，任何BOE [X]的输入是
LOW使BIST生成器/校验的相关
接收信道（或所述BIST发生器中相关的
传输通道） 。当BISTLE返回低电平，值
所有京东方[ X]信号被捕获的BIST使能锁存器。
这些值将保持在BIST使能锁存，直到BISTLE是
返回高电平。在BIST所有捕获的信号，使能锁存
设置为高（即BIST是禁用的）下一个器件复位
（ TRSTZ采样为低电平） 。
当BIST首先确认为被启用
接收器的线性反馈移位寄存器被预置到BIST环起动代码
D0.0 。这D0.0字符每BIST循环只发送一次。该
的BIST进步和任何字符不匹配状态
呈现在RXSTx [ 2：0]状态输出。
编码规则违规或发生的运行不一致错误
所述BIST循环的一部分，不会引起错误指示。
RXSTx [2： 0]指示010B或100b对一个字符的周期
每BIST循环显示循环完成。这个状态可以是
用于检查的测试图案的进步。这些相同的状态值
当解码器被旁路和BIST是呈现
在接收通道启用。
报告RXSTx状态[ 2：0]的BIST状态机
列于
表24中。
当接收BIST使能，
同样的状态报告的接收状态输出
不管DECMODE的状态。
每个接收器检查的具体模式进行说明
详细赛普拉斯应用笔记“的HOTLink内置
自检“。
该
顺序
相比
by
该
CYP （ V） （ W） 15G0401DXB时RXCKSEL = MID是相同的
到，在CY7B933和CY7C924DX ，允许的互
在兼容的串行使用时erable系统建设
信令速率。
如果接收到的无效字符数超过以往的
有效字符由16号，接收BIST状态
机器中止比较操作，并复位LFSR
到D0.0状态去寻找BIST序列的开始
再次。
当接收路径被配置为共同的时钟
操作（ RXCKSEL
≠
MID ），每个通前必须有
一个16个字符的字同步序列，以允许输出缓冲器
对准和时钟频率变化的管理。
这是由发送器自动生成时，其
当地RXCKSEL
≠
MID和编码器已启用（ TXMODE [ 1 ]
≠
低） 。
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