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MB93423
（2） SDRAM接口
(V
DE
=
3.3 V
±
0.15 V, V
DD
=
V
DDP
=
1.8 V
±
0.1 V, V
SS
=
0 V ，TA
=
0
°C
to
+
70
°C)
项
参数
DCLKFB周期（T
DCLKFB
)
DCLKFB时候
DCLKFB
输入
DCLKFB低的时间
DCLKFB上升时间
DCLKFB下降时间
DCS ＃[ 3：0]
DBA [1：0 ]
DA [ 12 ： 0 ]
DRAS ＃
SDRAM
I / F的输出
DCAS ＃
DWE ＃
DCKE
DDQM [0：3 ]
DDQ [31：0 ]
SDRAM
I / F输入
DDQ [31：0 ]
参考
信号
240兆赫
民
8.3*
2.5
2.5
1.0
1.0
1.0
1.0
1.0
1.0
1.0
1.0
1.0
1.0
1.0
1.0
最大
15*
1.0
1.0
4.5
4.5
4.5
4.5
4.5
4.5
4.5
4.5
4.5
266兆赫
民
7.5*
2.5
2.5
1.0
1.0
1.0
1.0
1.0
1.0
1.0
1.0
1.0
1.0
1.0
1.0
最大
15*
1.0
1.0
4.5
4.5
4.5
4.5
4.5
4.5
4.5
4.5
4.5
单位
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
输出有效延迟时间DCLKFB崛起
输出有效延迟时间DCLKFB崛起
输出有效延迟时间DCLKFB崛起
输出有效延迟时间DCLKFB崛起
输出有效延迟时间DCLKFB崛起
输出有效延迟时间DCLKFB崛起
输出有效延迟时间DCLKFB崛起
输出有效延迟时间DCLKFB崛起
输出有效延迟时间DCLKFB崛起
输出保持时间
输入建立时间
输入保持时间
DCLKFB崛起
DCLKFB崛起
DCLKFB崛起
*：该值是通过CMODE决定。
注意事项：
各参数是温度和电源电压，除非另有指定的范围内有效。
指出。
各电压值是基于与GND （Ⅴ
SS
=
0.0 V）的电平。定时测定基准点
是1.5伏时，输入电平为0.4伏到2.4伏，输入上升时间和下降时间是1.5纳秒或更小，除非
另有说明。
外部输出负载电容为30 pF的，除非另有说明。
输入到DCLKFB和从DCLK的输出的频率是由输入频率来决定
CLKIN ，并设置一个CMODE的[3： 0]引脚。请参考“ 5 。有关详细信息，时钟设置“ 。
设置保持
有效
HOLD
DCLKFB
输出引脚
输入
输出引脚
37
