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功能描述和应用信息
4.3
复位模块
与POR和RESET_IN复位模块的时序关系如图
科幻gure 3
和
图4中。
记
注意， NVDD必须上升到至少1.8V之前QVDD通电时
防止正向偏置。
90 ％ AVDD
1
POR
10 ％ AVDD
RESET_POR
2
确切的300毫秒
RESET_DRAM
3
7个周期@ CLK32
HRESET
RESET_OUT
4
14个循环@ CLK32
CLK32
HCLK
与POR图3.时序关系
5
RESET_IN
14个循环@ CLK32
HRESET
RESET_OUT
4
6
CLK32
HCLK
与RESET_IN图4.定时关系
MC9328MXL技术数据，版本8
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飞思卡尔半导体公司
