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图9 。
PLL过滤器连接
FILT
R
C1
VSS
VSS
C2
PLL编程
PLL被用在图10所示的流程只要时钟产生编程
使能时，用户必须等待，直到锁定指示器被设置为确保在时钟输出是
稳定。 PLL时钟频率将依赖于MP3解码器时钟和音频接口
时钟频率。
网络连接gure 10 。
PLL编程流程
PLL
程序设计
配置分频器
N6 ：0 = xxxxxxb
R 9 ：0 = xxxxxxxxxxb
启用PLL
PLLRES = 0
PLLEN = 1
PLL锁定？
PLOCK = 1 ？
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AT8xC51SND1C
4109E–8051–06/03
