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QPro的Virtex -II 1.5V军事QML平台FPGA
DCM
全局时钟多路复用器
DCM
IOB
可配置逻辑
可编程I / O
CLB
块状SelectRAM
倍增器
DS031_28_100900
图1：
的Virtex -II体系结构概述
内部可配置逻辑电路包括四个主要元件
组织中的规则阵列：
可配置逻辑块（CLB ）提供的功能
对于组合和同步逻辑单元，
包括基本的存储元件。 BUFTs （ 3态
缓冲区），每个CLB元件驱动相关
专用分割的水平布线资源。
块状SelectRAM内存模块提供大
的双端口RAM 18千比特的存储元件。
乘法器模块是18位×18位专用
乘法器。
DCM （数字时钟管理器）模块提供
自校准，对于时钟的全数字解
配送延迟补偿，时钟乘法
和分裂，粗粒度和细粒度时钟相位
换挡。
使用可选的单倍数据速率输入块或
双倍数据速率（DDR ）寄存器
使用可选的单倍数据速率或DDR输出块
寄存器，和一个可选的三态缓冲器，被驱动
直接地或通过一个或DDR寄存器
双向块（输入和输出的任意组合
CON连接gurations ）
这些寄存器是边沿触发的D型触发器
或电平敏感锁存器。
IOB支持以下单端I / O标准：
LVTTL ， LVCMOS （ 3.3V ， 2.5V ，1.8V和1.5V ）
PCI兼容的（ 33 MHz）的电压为3.3V
的CardBus兼容的（ 33 MHz）的电压为3.3V
GTL和GTLP
HSTL （ I类， II ， III ，和IV ）
SSTL （ 3.3V和2.5V ， I类和II ）
AGP-2X
新一代可编程布线资源被称为
主动互连技术互连所有这些
元素。一般的路由矩阵（ GRM）是阵列
路由交换机。每个可编程元件被连接到一个
切换矩阵，从而允许多个连接到一般
路由矩阵。总体可编程互连
分层的，旨在支持高速设计。
所有可编程元件，包括路由
资源，被存储在静态存储器中的值控制
细胞。这些值时，在存储器单元加载
配置，可重新加载修改功能
的可编程元件。
该数控阻抗（ DCI）的I / O功能，自动
matically提供片上端接的每个I / O单元。
IOB元件还支持以下差分显
信令I / O标准：
LVDS
BLVDS （总线LVDS ）
ULVDS
LDT
LVPECL
的Virtex -II产品特点
本节简要介绍的Virtex -II的特点。
两个相邻的焊盘被用于每一个差分对。两
4 IOB块连接到一个开关矩阵来访问
布线资源。
输入/输出模块（IOB ）
IOB可编程和可分类如下：
DS122 （ V1.1 ） 2004年1月7日
产品speci fi cation
www.xilinx.com
1-800-255-7778
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