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QPro的Virtex -II 1.5V军事QML平台FPGA
R
移位寄存器
每个函数发生器还可以被配置为一个16位的
移位寄存器。写操作是同步的一个
时钟输入(CLK)和一个可选的时钟使能,如图
图22 。
动态读取访问是通过执行
4位地址总线,A [ 3:0] 。可配置的16位移位寄存器
器不能被置位或复位。读出的是异步的,然而
以往,存储元件或触发器可用于
实现同步阅读。该存储元件
应始终使用同一个恒定地址。对于应试
的PLE ,构建一个8位的移位寄存器和配置时
地址指向的第七位,第八位可以是
触发器。系统的整体性能是由改进
利用优越的时钟到输出的触发器。
SHIFTIN
SRLC16
1移位链
在CLB
IN
DI
D
SRLC16
MC15
FF
DI
SRLC16
MC15
SLICE S3
FF
SHIFTOUT
SHIFTIN
DI
D
SRLC16
MC15
FF
移位寄存器
A[3:0]
4
A[4:1]
D
MC15
D
WS
D( BY )
WSG
CE ( SR )
CLK
WE
CK
(可选)
SHIFTIN
DI
D
SRLC16
MC15
DS031_05_110600
产量
Q
注册
产量
DI
SLICE S2
DI
SRLC16
MC15
FF
SHIFTOUT
FF
SHIFTOUT
图22 :
移位寄存器的配置
移位寄存器之间的附加的专用连接
允许连接一个移位寄存器的最后一位到第
的下位,在不使用普通的LUT输出。 (见
图23. )
更长的移位寄存器可以以动态地建
访问链中的任何一点。移位寄存器链
和MUXF5 , MUXF6和MUXF7多路复用器允许多达
到一个128位的移位寄存器寻址的访问是
在一个CLB实现。
DI
SRLC16
MC15
FF
SLICE S1
SHIFTOUT
SHIFTIN
DI
D
SRLC16
MC15
FF
DI
SRLC16
MC15
FF
SLICE S0
OUT
级联的OUT
DS031_06_110200
CLB
图23:
可级联移位寄存器
22
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DS122 ( V1.1 ) 2004年1月7日
产品speci fi cation