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FEDL9090A-01
1
半导体
ML9090A -01 ， -02
模型
ML9090A-01
税
1/8
1/9
1/10
1/16
寄存器Y设定范围和环路范围
0 7 （ 00H到07H ）
08 （ 00H到08H ）
0 9 （ 00H到09H ）
0 15 （ 00H到0FH ）
0 16 （ 00H到10H ）
0 17 （ 00H到11H ）
无效ADDRES设定范围
815 （ 08H至FH ）
9 15 （ 09H至FH ）
10 15 （ AH ，以FH ）
16 31 （ 10H到1FH ）
17 31 （ 11H到1FH ）
18 31 （ 12H到1FH ）
ML9090A-02
1/17
1/18
当一个无效的Y地址设置，无效地址的计算根据，虽然选择的责任及其变化
操作不放心。如果责任是1/8或1/16 ，寄存器计数，最多无效的Y地址
值（15对ML9090A -01或31的ML9090A - 02 ），并返回到0。与此同时，在X地址也
递增。
如果责任是1/9或1/17 ，寄存器计数到0地址处的“Y地址设置加1 ”后无效
地址被设置。同时，在X地址也增加。
如果责任是1/10或1/18 ，寄存器计数到0地址处的“Y地址设置加1”，地址为“Y
地址设置加1 “无效的Y地址后，设置。同时，在X地址也增加。后
此，Y地址计数循环在对应于所选择的占空比的范围内。
读取和写入的比特D7操作的ML9090A -01 D4为无效。
读取和写入的比特D7操作的ML9090A -02 D5是无效的。
该寄存器被复位到“ 0”时的
RESET
销是由低。
端口寄存器A（ PTA ）
D7
D6
D5
D4
—
D3
D2
D1
D0
PTA
端口寄存器A组（ “1” ）和重置（ “0” ），通用端口的数据。在PTA位的设置（ D0位）
对应于PA0输出引脚。如果
RESET
引脚被拉至“ L”电平，该寄存器被复位到“ 0”和
PA0引脚为高阻抗。后
RESET
引脚连接到一个“ H”电平，如果端口的数据在该寄存器中置位，则
PA0引脚从高阻抗状态解除，并输出对应的端口的数据。
端口寄存器B（ PTB ）
D7
PTB7
D6
PTB6
D5
PTB5
D4
PTB4
D3
PTB3
D2
PTB2
D1
PTB1
D0
PTB0
端口寄存器组（ “1” ）和重置（ “0” ）的通用端口B的数据。该PTB0到PTB7的设置
位（ D0到D7比特）对应于PTB0到PTB7输出管脚。如果
RESET
引脚被拉至“ L”电平，这
寄存器复位为“ 0”，引脚PTB0通过PTB7进入高阻抗。后
RESET
引脚连接到一个“H”的
水平，如果端口的数据在此寄存器设置，通过引脚PTB7 PTB0从他们的高阻抗状态解除，
输出对应的端口的数据。
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