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附录B
布局建议
为降低噪声
解耦LOW- PASS的R / C
滤波器设计
该PCNET -ISA II控制器是一个集成的单芯片
以太网控制器，它同时包含数字和
模拟电路。模拟电路包含一个高
高速锁相环（PLL）和电压的转换
受控振荡器（ VCO） 。由于混合信号的
该芯片的特点，一些额外的预防措施
与该设备进行设计时必须考虑到。
描述在本节中是一个简单的去耦
低通R / C滤波器，可显著增加噪音
PLL电路的免疫力，从而，防止噪音
扰乱VCO 。误码率，一个共同的测量
精神疾病的网络性能，其结果可以dras-
角度讲降低。在某些情况下，误码率可
降低了几个数量级。
此滤波器的实现不是必要的，实现
符合IEEE 802.3 specifi-官能产品
阳离子和提供足够的性能。不过，
此过滤器将帮助设计人员满足这些规范
更多的保证金。
威盛V
DD
V
DD
针
V
SS
针
威盛V
SS
飞机
PCNET -ISA II
19364B-85
AMD的建议，至少一个低频
大容量去耦电容可以在该区域使用
PCNET -ISA II控制器。 22
F电容工作过
还有这个。此外，共有四个或五个0.1
F
电容器已探明周围的DV充足
SS
和DV
DD
引脚提供ISA总线的驱动
输出管脚。
模拟解耦
最关键的引脚是模拟电源和接地
销。所有的模拟电源和接地引脚分别位于
在该装置的一个角落。具体要求
模拟电源引脚在下面列出。
AVSS1和AVDD3
这些引脚提供电源和接地的
双绞线和AUI驱动程序。因此，他们很
嘈杂。专用0.1
这些引脚之间F的电容
值得推荐。
AVSS2和AVDD2
这些引脚上的PCNET -ISA最关键的销
二控制器，因为它们提供的电源和
地对芯片的PLL部分。 VCO的部分
PLL的是，在60 kHz至200 kHz的噪声敏感
范围内。为了防止噪声在这个频率范围内，从
扰乱了VCO ， AMD公司强烈建议
如下所示的低通滤波器来实现上
这些引脚。使用此过滤器的测试表明显
着增加抗噪声性能和降低误码
在设计中使用的PCNET -ISA二率（BER ）的统计
控制器。
数字解耦
该DVSS引脚那颗最新的
那些提供地面为ISA总线输出
因为这些输出信号需要24毫安驱动。
该DVSS10和DVSS12引脚提供地面
内部数字逻辑。此外， DVSS11
提供地面内部数字和为
输入和I / O引脚。
在制造基于PC所使用的CMOS技术
净-ISA II控制器采用n型衬底。在这
技术，所有V
DD
管脚电连接到
对方内部。因此，在四层板中，当
V之间的解耦
DD
而关键的V
SS
销，出特殊
CI网络（C V）
DD
您连接到引脚不是关键的。事实上，在
V
DD
去耦电容器的连接可以是
直接向电力平面，靠近最接近V
DD
引脚连接到V
SS
引脚的兴趣。但是，我们建议
该V
SS
去耦电容的连接是
直接向V
SS
如图感兴趣销。
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