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初步
集成
电路
系统公司
ICS843034-01
F
EMTO
C
锁
M
ULTI
-R
吃
LVPECL F
Characteristic低频
S
YNTHESIZER
并联谐振晶体，并以最小化
ppm误差。最佳C1和C2的值可稍
针对不同的电路板布局调整。
C
RYSTAL
I
NPUT
I
覆盖整个院落
该ICS843034-01的特点与18pF之paral-
LEL谐振晶体。的电容值，C1和C2 ，如图
in
图4
下面用一个25MHz的， 18pF之确定
XTAL_OUT
C1
22p
X1
18pF之并行水晶
XTAL_IN
C2
22p
ICS843034-01
ICS84332
图4.
RYSTAL
I
NPU
T I
覆盖整个院落
D
。微分
C
LOCK
I
NPUT
I
覆盖整个院落
在CLK / NCLK接受LVDS ， LVPECL ， LVHSTL ， SSTL ， HCSL
和其他差分信号。双方V
摇摆
和V
OH
必须满足
V
PP
和V
CMR
输入要求。图5A到5D示出跨
为HiPerClockS CLK / NCLK输入的驱动脸上的例子
最常见的驱动程序类型。输入接口建议
这里仅是例子。请与该供应商协商
驱动器部件，以确认驱动器端接的要求。
例如在
图5A中，
输入端接适用于ICS
HiPerClockS LVHSTL驱动程序。如果您使用的是LVHSTL驱动程序
从其他供应商，使用他们的终端建议。
3.3V
3.3V
3.3V
1.8V
ZO = 50欧姆
ZO = 50欧姆
CLK
ZO = 50欧姆
NCLK
LVHSTL
ICS
HiPerClockS
LVHSTL驱动程序
R1
50
R2
50
R3
50
LVPECL
ZO = 50欧姆
CLK
NCLK
HiPerClockS
输入
HiPerClockS
输入
R1
50
R2
50
F
IGURE
5A 。
I
P
ER
C
LOCK
S CLK / NCLK我
NPUT
D
BY四分五裂
ICS
I
P
ER
C
LOCK
S LVHSTL
河
3.3V
3.3V
3.3V
R3
125
ZO = 50欧姆
CLK
ZO = 50欧姆
NCLK
LVPECL
R1
84
R2
84
HiPerClockS
输入
R4
125
F
IGURE
5B 。
I
P
ER
C
LOCK
S CLK / NCLK我
NPUT
D
BY四分五裂
3.3V LVPECL
河
3.3V
3.3V
LVDS_Driv器
R1
100
ZO = 50欧姆
ZO = 50欧姆
CLK
NCLK
输入接收器
F
IGURE
5C 。
I
P
ER
C
LOCK
S CLK / NCLK我
NPUT
D
BY四分五裂
3.3V LVPECL
河
843034AY
-01
F
IGURE
5D 。
I
P
ER
C
LOCK
S CLK / NCLK我
NPUT
D
BY四分五裂
3.3V LVDS
河
REV 。 2005年11月28日
www.icst.com/products/hiperclocks.html
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