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高速3.3V 16K ×36
同步PIPELINED
双口静态RAM
3.3V或2.5V接口
产品特点：
x
x
IDT70V3569S
x
x
x
x
真正的双端口存储器单元，可同步
相同的内存位置的访问
高速时钟对数据的访问
- 商业： 4.2 / 5 / 6ns的（最大）
- 工业： 5 / 6ns的（最大）
流水线输出模式
计数器使能和复位功能
双芯片能够允许深度扩展，而不
附加逻辑
在两个端口全同步操作
- 7.5ns周期， 133MHz的运行（ 9.6 Gbps的带宽）
- 快速4.2ns的时钟到数据输出
- 1.8ns设置时钟和0.7ns持有的所有控制，数据和
x
x
x
x
x
地址输入@ 133MHz的
- 数据输入，地址，字节使能和控制寄存器
- 自定时写允许快速循环时间
对于复用总线和总线独立控制字节
匹配的兼容性
LVTTL-兼容，采用3.3V单电源（ ± 150mV的）电源供应
CORE
LVTTL-兼容，可选择的3.3V （ ± 150mV的） /2.5V （ ± 125mV ）
每个端口上的电源为I / O和控制信号
工业级温度范围（-40 ° C至+ 85°C ）是
可供选择的速度
可在一个208引脚塑料四方扁平封装（ PQFP ）
208球细间距球栅阵列，以及256引脚球
栅格阵列
功能框图
BE
3L
BE
3R
BE
2L
BE
1L
BE
0L
BE
2R
BE
1R
BE
0R
读/写
L
B
W
0
L
B
W
1
L
B
W
2
L
B B
WW
3 3
L R
BB
WW
2 1
RR
B
W
0
R
读/写
R
CE
0L
CE
1L
CE
0R
CE
1R
OE
L
Dout0-8_L
Dout9-17_L
Dout18-26_L
Dout27-35_L
Dout0-8_R
Dout9-17_R
Dout18-26_R
Dout27-35_R
OE
R
16K ×36
内存
ARRAY
I / O
0L
- I / O
35L
Din_L
Din_R
I / O
0R
- I / O
35R
CLK
L
A
13L
A
0L
CNTRST
L
ADS
L
CNTEN
L
CLK
R
,
计数器/
地址
注册。
A
13R
ADDR_L
ADDR_R
计数器/
地址
注册。
A
0R
CNTRST
R
ADS
R
CNTEN
R
4831 TBL 01
2001年4月
1
2001集成设备技术有限公司
DSC八分之四千八百三十一
