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IDT72V3682 / 72V3692 / 72V36102 3.3V CMOS SyncBiFIFO
TM
16384 ×36× 2 32768 ×36× 2和65536 ×36× 2
商业级温度范围
t
CLKH
CLKA
CSA
W / RA
工商管理硕士
ENA
高
低
低
低
t
CLK
t
CLKL
t
ENS2
t
ENH
ORA
A0 -A35
t
A
下一个字从FIFO2
上一个单词FIFO2输出寄存器
t
SKEW1
(1)
CLKB
IRB
CSB
FIFO2全部
低
t
CLKH
1
t
CLK
t
CLKL
2
t
PIR
t
PIR
W / RB
低
t
ENS2
MBB
t
ENS2
ENB
t
DS
B0 - B35
写
到FIFO2
t
ENH
t
ENH
t
DH
4679 DRW 17
注意：
1. t
SKEW1
是一个上升缘CLKA和CLKB的上升边缘对IRB的过渡HIGH在下一CLKB的周期之间的最小时间。如果上升CLKA边缘，上升之间的时间
CLKB边缘小于吨
SKEW1
，然后IRB可以转换高一CLKB周期晚于所示。
图14. IRB标志时序，并首先提供写时FIFO2已满（ FWFT模式）
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