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TMS320VC5409A
固定PointDigital信号处理器
SPRS140F - 2000年11月 - 修订2005年1月
1
TMS320VC5409A特点
先进的多总线架构，具有三
独立的16位数据存储器总线和一个
程序存储器总线
40位算术逻辑单元（ ALU ），包括
40位的桶形移位器和两个独立
40位累加器
17-
×
17位并行乘法器耦合到
40位专用加法器，用于非流水线
单周期乘法/累加（ MAC ）
手术
比较，选择和存储单元（ CSSU ）为
添加/比较选择维特比算的
指数编码器来计算指数
在一个40位累加器的值值
单曲循环
两个地址生成八个辅助
寄存器和两个辅助寄存器
运算单元（ ARAUs ）
数据总线与总线持有人功能
扩展寻址模式为8M
×
16-Bit
最大可寻址外部程序
空间
32K ×16位的片上RAM组成：
- 8K的四大板块
×
16位片上
双存取程序/数据RAM
16K
×
16位片上ROM配置
程序存储器
增强外部并行接口（ XIO2 ）
单指令重复和块重复
操作的程序代码
块存储，传送指令为更好
程序和数据管理
说明随着32位长字操作数
说明随着两个或三个操作数
读和写
算术指令采用并行存储和
并行加载
条件存储指令
快速中断返回
片上外设
- 软件可编程等待状态
发生器和可编程
银行交换
- 片上可编程锁相环
回路（ PLL ）时钟发生器，内部
振荡器或外部时钟源
(1)
- 1个16位定时器
- 六通道直接存储器存取（ DMA ）
调节器
- 三个多通道缓冲串行端口
（ McBSP的）
- ，8/16位增强型并行主机端口
接口（ HPI8 / 16 ）
功耗控制使用IDLE1 ，
IDLE2和IDLE3说明随着
掉电模式
CLKOUT关控制禁用CLKOUT
片基于扫描的仿真逻辑， IEEE
1149.1 （ JTAG ）边界扫描逻辑
(2)
144引脚球栅阵列（ BGA ） （ GGU后缀）
144引脚小外形四方扁平封装（ LQFP ）
（ PGE后缀）
6.25 ns的单周期定点指令
执行时间（ 160 MIPS）的
8.33 ns的单周期定点指令
执行时间（ 120 MIPS ）
3.3 V的I / O电源电压（ 160和120 MIPS ）
1.6 -V内核电源电压（ 160 MIPS ）
1.5 -V内核电源电压（ 120 MIPS ）
(1)
(2)
片上振荡器并非适用于所有5409A的设备。
对于适用的设备，请参阅TMS320VC5409A数字
信号处理器芯片勘误表（文献编号SPRZ186 ） 。
IEEE标准1149.1-1990标准试验访问端口和
边界扫描结构。
TMS320C54x系列，微星BGA ， C54x中， TMS320C5000 ， C5000 ， TMS320是德州仪器的商标。
所有商标均为其各自所有者的财产。
PRODUCTION数据信息为出版日期。
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仪器标准保修。生产加工过程中不
不一定包括所有参数进行测试。
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