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电气特性
3.9
外部总线时序
记
所有的处理器总线时序是同步的;也就是说，输入建立/保持和输出延迟
相对于基准时钟的上升沿。参考时钟是
CLKOUT输出。所有其它的定时关系可以是来自于这些值。
表24.外部总线输入时序规格
1
表24
列出了处理器总线输入定时，这示于
图6 ，图7中
和
网络连接gure 8 。
NUM
M1
C
P CLKOUT周期
2
等级
符号
t
CYC
民
20
最大
—
单位
ns
控制输入
M2a
M3a
P控制输入有效到CLKOUT高
3
P CLKOUT高到控制输入无效
3
数据输入
M4
M5
P数据输入（ DATA [ 15 ： 0 ] ），有效使CLKOUT高
P CLKOUT高到数据输入（DATA [15： 0]）无效
t
DIVCH
t
CHDII
9
0
—
—
ns
ns
t
CVCH
t
CHCII
13
0
—
—
ns
ns
注意事项：
1.假设CLKOUT配置为全驱动强度（通过PIM CONFIG2_D [ RDS ]位） 。
2. CLKOUT等于系统时钟
f
SYS
。如果CLKSEL [ PLLSEL ]被设置，那么
f
SYS
等于
f
VCO
（表
表20
K3);
如果它是清楚然后
f
SYS
等于
f
OSC
（表
表19 ， J1A
or
J1b).
在本文档中，T
CYC
用于
指定时间单位等于1
÷
CLKOUT （它等于吨
FSYS
).
3. TA引脚上MAC7100系列器件的唯一控制输入。
CLKOUT （ 50兆赫）
t
格局
1.5 V
t
HOLD
输入设置保持&
无效
1.5 V适用1.5 V
无效
输入上升时间
V
H
= V
IH
V
L
= V
IL
t
上升
= 1.5纳秒
输入下降时间
V
H
= V
IH
V
L
= V
IL
t
秋天
= 1.5纳秒
CLKOUT
M4
M5
输入
图6.通用输入时序要求
MAC7100单片机系列硬件规格，版本1.2
20
初步
飞思卡尔半导体公司
