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结构概述
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1/8 ， 1/4，1/2 ， 3/4或7/8 FIFO触发水平
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标准的异步通信位：起始位，停止位，奇偶
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假起始位检测
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行中止的产生和检测
ADC
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独立和差分输入配置
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为单端输入时8个10位的通道（输入）
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500000样本的采样率/秒
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灵活的，可配置的模拟到数字转换
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从一到8个入口长四个可编程的采样转换序列，
相应的转换结果FIFO
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每个序列由软件或者内部事件（定时器或GPIO ）
I
2
C
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主机和从机接收和发送操作的速度可达100Kbps的中
在快速模式标准模式和400 Kbps的
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中断产生
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主机带有仲裁和时钟同步功能，支持，和7位
寻址模式
个GPIO
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7 28个GPIO ，取决于配置
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5 V容错输入/输出
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中断产生可编程为边沿触发或电平检测
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通过地址线进行位屏蔽的读取和写入操作
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可启动一个ADC采样序列
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可编程控制GPIO端口的配置：
动力
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片上低压差（ LDO）稳压器，具有可编程的输出用户可调
从2.25 V至2.75 V
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控制器的低功耗选项：睡眠和深度睡眠模式
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低功耗选项外设：单个外设的软件控制关机
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用户可启用LDO的未调节电压检测及自动复位
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3.3 V电源掉电检测，可通过中断或复位报告
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片上温度传感器
弱上拉或下拉电阻
2毫安， 4 - mA和8 - mA引脚驱动
压摆率控制在8 -mA驱动
开漏使能
数字输入使能
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初步
2007年4月27日
