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ATT3000系列现场可编程门阵列
数据表
1997年2月
CON组fi guration模式
（续）
链
该
ORCA
代工ATT3000开发系统
被用来创建复合CON组fi guration比特流
对选定的FPGA包括前同步码，长度
算的总比特流中，多个串联
数据的程序，一个后置，加上一个额外的连接LL位
每个设备在串行链中。装载和传球后
对前导码和长度计数到一个可能的菊花
链，铅设备将装载它的CON组fi guration数据
帧，同时提供高DOUT到可能的向下
如图25加载contin-流装置
而UE的铅设备已收到CON组fi guration
程序和当前长度计数还没有达到
的全部价值。附加数据是通过传递
导致设备和出现在数据输出（ DOUT ）引脚
串行形式。领先的设备也产生了CCLK
来同步的串行输出数据和数据
下游的FPGA。数据在奴隶DIN阅读
由CCLK的上升沿设备和移出
上的CCLK的下降沿的DOUT 。并行
主模式设备使用其内部定时发生器
以产生8倍的EPROM内的CCLK
处理速度，而外围模式装置产生
一阵8个CCLK每个片选和直写
频闪周期。内部定时发生器继续
操作对于一般的定时和同步
输入的所有模式。
+5 V
+5 V
M0 M1 PWRDWN
+5 V
+5 V
M0 M1 PWRDWN
5 k
CCLK
DIN
A15
A14
A13
A12
A11
A10
A9
A8
A7
A6
A5
A4
A3
A2
A1
A0
OE
CE
8
集电极开路
D7
D6
D5
D4
D3
D2
D1
D0
D / P
RESET
INIT
EPROM
其他
I / O引脚
M0 M1 PWRDWN
5 k
CCLK
DIN
DOUT
M2
HDC
最不发达国家
常规 -
用途
用户I / O
5 k
M2
HDC
最不发达国家
RCLK
CCLK
DOUT
A15
A14
A13
A12
其他
I / O引脚
A11
A10
FPGA
主
D7
D6
D5
D4
D3
D2
D1
D0
A9
A8
A7
A6
A5
A4
A3
A2
A1
A0
D / P
RESET
INIT
DOUT
M2
HDC
最不发达国家
常规 -
用途
用户I / O
引脚
FPGA
从站＃ 1
FPGA
从站#N
常规 -
用途
用户I / O
其他
I / O引脚
D / P
RESET
INIT
+5 V
5 kΩ的每
改编
系统
RESET
5-3116(F)
菊花链从模式设备图25.主模式
26
朗讯科技公司
