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ADSP-BF561
SDRAM接口时序
表19. SDRAM接口时序
参数
时序要求
t
SSDAT
数据建立CLKOUT前
t
HSDAT
数据保持CLKOUT后
开关特性
t
SCLK
CLKOUT周期
1
CLKOUT宽高
t
SCLKH
t
SCLKL
CLKOUT宽度低
t
DCAD
命令， ADDR ，数据延迟CLKOUT后
2
t
HCAD
命令， ADDR ，数据保持CLKOUT后
2
t
DSDAT
数据禁止CLKOUT后
t
ENSDAT
数据使能CLKOUT后
1
2
民
2.1
0
7.5
2.5
2.5
最大
单位
ns
ns
ns
ns
ns
ns
ns
ns
ns
4.0
0.8
4.0
1.0
请参阅
22页的表15
为最大值Fi
SCLK
在不同的V
DDINT
.
命令引脚包括： SRAS ， SCAS ， SWE ， SDQM ， SMS3-0 ， SA10 ， SCKE 。
t
SCLK
CLKOUT
t
SCLKH
t
SSDAT
t
HSDAT
数据（IN）的
t
SCLKL
t
DCAD
t
ENSDAT
数据（OUT ）
t
SDA牛逼
t
HCAD
t
DCAD
CMND ADDR
（下）
t
HCAD
注： COMMAND =
SRAS ， SCAS ， SWE ，
SDQM ，
短信，
SA10 ， SCKE 。
图11. SDRAM接口时序
版本A |
第26页60 |
2006年5月
