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ADSP-BF561
数据接收，内部时钟
DRIVE
EDGE
样品
EDGE
数据接收外部时钟
DRIVE
EDGE
样品
EDGE
t
SCLKIW
RSCLK
RSCLK
t
SCLKEW
t
DFSE
t
HOFSE
RFS
t
DFSE
t
SFSI
t
HFSI
RFS
t
HOFSE
t
SFSE
t
高场强元素
t
SDRI
DR
t
HDRI
DR
t
SDRE
t
HDRE
注意：无论是上升沿或RCLK或TCLK下降沿可以用作活性采样边沿。
传送数据，内部时钟
DRIVE
EDGE
样品
EDGE
传输数据，外部时钟
DRIVE
EDGE
样品
EDGE
t
SCLKIW
TSCLK
TSCLK
t
SCLKEW
t
DFSI
t
HOFSI
TFS
t
DFSE
t
SFSI
t
HFSI
TFS
t
HOFSE
t
SFSE
t
高场强元素
t
DDTI
t
HDTI
DT
DT
t
DDTE
t
HDTE
注意：无论是上升沿或RCLK或TCLK下降沿可以用作活性采样边沿。
DRIVE
EDGE
TSCLK （ EXT ）
TFS （ "LATE" ， EXT ）。
TSCLK / RSCLK
DRIVE
EDGE
t
DTENE
DT
DRIVE
EDGE
TSCLK （ INT ）
TFS （ "LATE" ， INT ）。
TSCLK / RSCLK
DRIVE
EDGE
t
DDTTE
t
DTENI
DT
t
DDTTI
图17.串行端口
版本A |
第32页60 |
2006年5月
