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ADSP-BF534/ADSP-BF536/ADSP-BF537
10/100以太网MAC控制器时序
表34
通过
表39
和
图29
通过
图34
描述了10/100以太网MAC控制器操作。这
功能仅适用于ADSP- BF536和ADSP- BF537
处理器。欲了解更多信息，请参阅
表1第3页。
表34. 10/100以太网MAC控制器时序： MII接收信号
参数
1
t
ERXCLKF
t
ERXCLKW
t
ERXCLKIS
t
ERXCLKIH
1
ERxCLK频率（f
SCLK
= SCLK频率）
ERxCLK宽度（T
erxclk
= ERxCLK期）
RX输入有效到ERxCLK上升沿（数据输入设置）
ERxCLK上升沿RX输入无效的（在数据保持）
民
无
t
erxclk
×
35%
7.5
7.5
最大
25 MHz的+ 1 ％
f
SCLK
+ 1%
t
erxclk
×
65%
单位
ns
ns
ns
ns
信息产业部输入同步到ERxCLK是ERxD3-0 ， ERxDV和ERXER 。
表35. 10/100以太网MAC控制器时序： MII发送信号
参数
1
t
ETF
t
ETXCLKW
t
ETXCLKOV
t
ETXCLKOH
1
ETxCLK频率（f
SCLK
= SCLK频率）
ETxCLK宽度（T
etxclk
= ETxCLK期）
ETxCLK上升沿TX输出有效（数据输出有效）
ETxCLK上升沿TX输出无效（数据输出保持）
民
无
t
etxclk
×
35%
0
最大
25 MHz的+ 1 ％
f
SCLK
+ 1%
t
etxclk
×
65%
20
单位
ns
ns
ns
ns
MII输出同步到ETxCLK是ETxD3-0 。
表36. 10/100以太网MAC控制器时序： RMII接收信号
参数
1
t
EREFCLKF
t
EREFCLKW
t
EREFCLKIS
t
EREFCLKIH
1
REF_CLK频率（f
SCLK
= SCLK频率）
EREF_CLK宽度（T
EREFCLK
= EREFCLK期）
RX输入有效到RMII REF_CLK上升沿（数据输入设置）
RMII REF_CLK上升沿RX输入无效的（在数据保持）
民
无
t
EREFCLK
×
35%
4
2
最大
50 MHz的+ 1 ％
2
×
f
SCLK
+ 1%
t
EREFCLK
×
65%
单位
ns
ns
ns
ns
RMII输入同步到RMII REF_CLK是ERxD1-0 ， RMII CRS_DV和ERXER 。
表37. 10/100以太网MAC控制器时序： RMII发送信号
参数
1
t
EREFCLKOV
t
EREFCLKOH
1
民
RMII REF_CLK上升沿TX输出有效（数据输出有效）
RMII REF_CLK上升沿TX输出无效（数据输出保持）
2
最大
7.5
单位
ns
ns
RMII输出同步到RMII REF_CLK是ETxD1-0 。
版本B
|页68 47 | 2006年7月
