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AZ100LVEL16VR
MLP 16 （ VRL ）和模具（ VRX ）
AZ100LVEL16VRL
MLP 16
Q
Q
D
D
470
4毫安EA 。
Q
CS- SEL
Q
HG
Q
HG
10毫安EA 。
Q
15
NC
14
V
CC
13
12 CS- SEL
16
NC
D
D
1
2
3
4
5
EN
V
BB
假垫
打开或
连接
V
EE
11
10
9
Q
HG
Q
HG
EN -SEL
EN
CMOS / TTL
门槛
V
EEP
V
EE
EN -SEL
V
BB
6
NC
7
V
EE
8
V
EEP
AZ100LVEL16VRL ， VRX
顶视图
启用真值表
EN -SEL
EN
Q/Q Q
HG
Q
HG
NC
PECL低，V
EE
或NC
数据数据数据
NC
PECL高或V
CC
数据低高
1
V
EE
数据低高
CMOS低，V
EE
或NC
1
V
EE
CMOS高或V
CC
数据数据数据
1,2
V
CC
或V
BB
数据低高
CMOS低或V
EE
1,2
V
CC
或V
BB
CMOS高，V
CC
或NC数据数据数据
1
EN -SEL的连接必须是
≤1Ω.
2
日期码之前的0428不支持此操作模式。
引脚说明
针
电流源真值表
CS- SEL
Q
Q
NC
4毫安典型。
4毫安典型。
1
V
EE
8毫安典型。
8毫安典型。
1
V
CC
0
4毫安典型。
1
连接到V
CC
或V
EE
必须是
≤1Ω.
D/D
Q/Q
Q
HG
/Q
HG
V
BB
EN -SEL
EN
CS- SEL
V
EEP
V
EE
V
CC
功能
数据输入
数据输出
数据输出瓦特/高增益
参考电压输出
使能逻辑选择
使能输入
选择Q和Q电流源
大小
可选Q
HG
和Q
HG
当前
来源
负电源
正电源
2007年4月* REV - 15
www.azmicrotek.com
2
