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第1章设备概述MC9S12XE -家庭
- 向上兼容MC9S12指令集，除了网络连接已经模糊的说明
（ MEM ， WAV ， WAVR ， REV ， REVW ），它已被删除
- 增强的变址寻址
- 访问大量数据段独立的PPAGE
INT （中断模块）
- 八个级别的嵌套中断
- 中断源每个灵活分配中断级。
- 外部非屏蔽高优先级中断（ XIRQ ）
- 内部非屏蔽高优先级的内存保护单元中断
- 最多24个引脚的端口 ，H和P CON连接可配置为上升沿或下降沿触发中断
EBI （外部总线接口） （ 208引脚和144引脚封装仅提供）
- 最多四个芯片选择输出选择16K， 1M，2M和高达4MByte地址空间
- 每个片选输出可以CON组fi gured完成交易的任何超时之一
两个等待状态发生器或EWAIT信号的无效的
MMC （模块映射控制）
DBG （调试模块）
- CPU和/或XGATE总线具有触杀型或力量型的断点请求监控
- 64× 64位的循环跟踪缓冲区一次捕捉变化OF-溢流或存储器存取信息
BDM （背景调试模式）
MPU （内存保护单元）
- 8地址段德网络nable每个活动计划任务
- 地址范围粒度低至8字节
- 不写/否执行保护属性
- 在访问冲突不可屏蔽中断
XGATE
- 可编程，高性能的I / O协处理器模块
- 传输数据或从所有外设和内存，而无需CPU干预或CPU的等待状态
- 执行逻辑，移位，算术运算和位运算的数据
- 可以中断HCS12X CPU信号传输完成
- 触发从任何硬件模块，以及从CPU可能
- 两个中断级维修的高优先级任务
- 堆栈指针初始化硬件支持
OSC_LCP （振荡器）
- 低功率闭环控制皮尔斯振荡器利用4MHz至16MHz的晶振
- 良好的抗噪声性能
- 利用2MHz至40MHz的晶振满摆幅皮尔斯选项
- 跨导的大小以获得最佳初创保证金典型的晶体
IPLL （内部网络连接过滤的，频率调制的锁相回路时钟生成）
无需外部元件
MC9S12XE -系列参考手册，修订版1.07
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飞思卡尔半导体公司
