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LTC2351-14
应用S我FOR ATIO
高品质的钽电容和陶瓷旁路电容应
在V中使用
CC
, V
DD
和V
REF
销中所示
框图本数据手册的第一页上。为
最佳的性能，一个10μF的表面贴装钽
电容器用0.1μF陶瓷推荐的
V
CC
, V
DD
和V
REF
销。另外， 10μF的陶瓷芯片
电容器如X5R或X7R都可以使用。该电容
器必须尽可能靠近相应的引脚越好。该
迹线连接销和旁路电容器必须
尽量短，并应广泛取得越好。该
V
CC
和V
DD
旁路电容器返回到接地平面
和V
REF
旁路电容器返回到引脚22。护理
应采取以放置0.1μF V
CC
和V
DD
绕行
电容尽量靠近引脚24和25是可能的。
图6给出了推荐的系统接地连接
系统蒸发散。所有模拟电路的理由应被终止
LTC2351-14的裸露焊盘。从地面返回
LTC2351-14到电源应该是低阻抗
ANCE的无噪声运行。在32位的裸露焊盘
引脚QFN封装，内部也绑在地上垫。
裸露焊盘应在印刷电路板上进行焊接
减少接地电感。所有接地引脚
端（GND ，DGND OGND ）必须直接连接到
在LTC2351-14同一地平面。
OV
DD
BYPASS ，
0.1F, 0402
V
DD
BYPASS ，
0.1F, 0402
V
CC
BYPASS ，
0.1μF ， 0402和
10F, 0805
V
REF
BYPASS ，
10F, 0805
图6.推荐布局
18
U
硬件接口TO TMS320C54x系列
该LTC2351-14是串行输出的ADC的接口
在设计用于高速缓冲串行端口
高速数字信号处理器（DSP） 。图7示出
例如，使用TMS320C54X这个接口。
在TMS320C54x系列的缓冲串行端口有直接
访问的内存2kB的段。 ADC的串行
数据可以被收集在两个交替1kB的段，在
实时在的全1.5Msps的转化率
LTC2351-14 。该DSP汇编代码设置帧同步
在BFSR销模式，接受外部的正向
脉冲，并在BCLKR针串行时钟接受一个
外部上升沿时钟。附近的LTC2351-14缓冲器
可被添加到驱动长音轨给DSP以防止
该信号LTC2351-14的腐败。这种配置
灰是足够遍历一个典型的系统板，但
在缓冲输出和终端源电阻
电阻器在所述的DSP中，可以根据需要相匹配的字符
很长的传输线的teristic阻抗。如果您
需要终止SDO传输线，首先是缓冲
与一个或两个74ACxx栅极。的TTL输入阈值
与使用3V摆幅DSP的端口应对得当
该LTC2351-14 。
LTC2351-14
OV
DD
CONV
3
30
3V
5V
TMS320C54x
V
CC
BFSR
SCK
SDO
OGND
DGND
32
1
2
31
CONV
CLK
3线串行
接口LINK
235114 F06
W
U U
BCLKR
B13
B12
BDR
0V至3V逻辑摆幅
图7. DSP的串行接口来TMS320C54x系列
235114f
