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LABEL
CLKIN
~RES1,
~RES2
I
I / O类型
信号/定义
开销信号
时钟输入。
连接到外部28.224 MHz的时钟电路。
复位。
RESET低持有MDP在复位状态。 从RESET复位将高版本的MDP
状态并开始使用电源接通（默认）值正常运行。 RESET必须保持低电平至少
3微秒。新千年民主党已准备好 RESET低到高的转变后，使用400毫秒。 RES1和RES2 有
典型地连接到MCU RESET输入和向主机总线复位（ RESET或通过反相器）线
（并行主机）或复位电路（串口DTE接口），它在电源接通复位MCU和MDP 。
RES1和RES2 有活动的内部上拉电阻。
唤醒复位。
WKRES内部连接到RESET 但不会开车的MDP RESET引脚。
断言 WKRES执行相同的复位功能的MDP -RESET和通常使用由MCU来
从休眠模式唤醒时， MDP的MDP RESET线不能被有效（因为他们也是
连接到MCU RESET输入） 。对于DTE串口或并口主机MCU的配置，连接 WKRES到
单片机 WKRESOUT输出。 WKRES拥有活跃的内部上拉电阻。
+ 3.3V数字电路供电。
通过数字电路电源滤波器连接到+ 3.3V 。
+ 3.3V的模拟电路数字电源。
通过数字电路电源滤波器连接到+ 3.3V 。
模拟电路模拟电源。
通过模拟电路的电源滤波器连接到+ 5V 。
输入参考电压。
参考电压为+ 5V容限输入引脚。连接到+ 5V 。
数字地。
连接到数字地。
模拟地。
连接到模拟地。
X时钟。
在56.448兆赫（ PLL禁用）或63.5045输出时钟（使能PLL ） ，这期间MDP正常运行
模式，在休眠模式下关闭。
Y时钟。
输出时钟频率为28.224兆赫，这期间MDP正常模式下运行，并且在睡眠模式下关闭
模式。
系统时钟。
输出时钟频率为28.224兆赫，这期间MDP正常模式和休眠模式下运行。
PLLVDD连接。
通过10连接到+ 3.3V （ VDD ）
并通过10至DGND （+）
F.
PLLGND连接。
连接到DGND 。
并行主机接口
IA
WKRES
IA
VDD
AVDD
AVAA
VGG
GND
AGND
XCLK
共青
SYCLK
PLLVDD
PLLGND
PWR
PWR
PWR
REF
GND
GND
OA
OA
OA
PLL
PLL
地址，数据，控制和中断硬件接口信号允许MDP连接到一个8086兼容微处理器总线。与
除了外部逻辑的，接口可以被制成具有多种其它的微处理器，如6502 ， 8086或兼容
68000微处理器接口允许微处理器改变MDP配置，读取或写入信道和诊断数据，并
监督MDP操作通过写控制位，读状态位。
D0–D7
RS0–RS4
IA / OB
IA
数据线。
八双向数据线（ D0-D7 ）提供的数据在主机和之间并行传送
MDP 。最显著位D7 。数据方向由读控制使能和写使能信号。
寄存器选择信号线。
五高电平有效寄存器选择线（ RS0 - RS4 ）地址接口存储器寄存器
内MDP接口存储器。这些线通常连接到五个最低显著线（A0 A4 ）
的地址总线。
该MDP通过RS4解码RS0 ，解决32个内部接口存储器寄存器（ 00-1F ）之一。该
最显著的地址位为RS4 ，而最显著的地址位RS0 。所选择的寄存器可以是
从读出或经由8位并行数据总线（ D0-D7 ）写入。最显著数据位D7 ，而
至少显著数据位为D0 。
θCS
，阅读
IA
IA
片选。
CS选择MDP微处理器总线操作。 CS通常通过解码生成
主机地址总线。
读使能。
在读周期（ READ断言） ，从所选择的接口存储器寄存器中的数据被选通
到由在所述MDP三态驱动器装置的数据总线上。这些驱动力的数据线为高一
位，或低的零位。当不被读取，三态驱动器承担起自己的高阻抗状态（OFF） 。
写使能。
在写周期期间（写置位） ，从数据总线上的数据被复制到所选择的MDP
接口存储器寄存器，与代表1和0的比特状态，分别高和低的总线电平。
打断
请求。
所述MDP的IRQ输出可以被连接到在所述主处理器的中断请求输入
以中断主机程序执行立即MDP的服务。 IRQ输出可以在启用
MDP接口存储器，表示条件立即改变。使用的IRQ是可选的，这取决于
MDP的应用。该IRQ输出由TTL兼容的CMOS驱动器驱动。
“写
IRQ
IA
OA
0'
