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PACE 1757 M / ME
THE PACE1757M和PACE1757ME之间的差异
该PACE1757ME ，它使用P1750AE的CPU，实现了41％的性能提高（时钟周期）通过
PACE1757M ，它使用P1750A的CPU。这减少了每个指令的时钟是因为三个建筑
增强功能：
1.包含一个24 ×24乘法累加（ MAC）阵列。
2.在非总线周期为2个时钟的减少（总线周期维持在4个时钟周期，以保持与CPU的外设完全兼容
芯片） 。
3.科计算逻辑。
下表显示了MAC如何提高所有乘法运算 - 整数和浮点 - 由477 ％至760 ％
PACE1750AE
PACE1750A
钟
4
9
23
69
28
51
43
96
12
4
71
147
执行
时间
（ 40兆赫）
100ns
225ns
575ns
1725ns
700ns
1225ns
1075ns
2400ns
300ns
100ns
1775ns
3675ns
2.52
指令
整数添加/分
双精度整数添加/分
整数乘法
双精度整数添加/分
浮动添加/分
伸长的漂浮添加/分
乘法浮动
扩展的浮点乘法
科（两者）
科（不发生转移）
Flt'g “点多项式步骤（德穆尔+添加/子）
外部Flt'g “点多项式步骤（ Mul的/子）
DAIS混合（ MIPS）的
钟
4
6
4
9
18
34
9
17
8
4
27
51
执行
时间
（ 40兆赫）
100ns
150ns
100ns
225ns
450ns
850ns
225ns
425ns
200ns
100ns
675ns
1275ns
3.56
收益
＃时钟
(%)
50
575
760
55
50
477
564
50
263
2400
41/59
PACE1757ME内置函数
一组核心的额外的指令已被列入PACE1757ME 。这些指令使用内置函数（ BIF ）
操作码的空间。这些新的操作码的目的是提高对PACE的关键应用领域的性能
诸如导航，DSP，超越数等LINPAK和矩阵类型的指令。下面是内建函数和的列表的
执行次（N =正在处理中的向量的元素的数目） 。
指令
内存参数点产品 - 单
内存参数点产品 - 双
3× 3点注册产品
双精度乘法累加
多项式POLY
清除累加器CLAC
存储累加器（ 32位）
存储累加器（ 48位）
加载累加器（ 32位）
加载累加器长（ 48位）
移动MMU页块
装载定时器A复位寄存器
加载定时器B复位寄存器
助记符
VDPS
VDPD
R3DP
MACD
4F06
4F00
STA
实达
LAC
LACL
MMPG
LTAR
LTBR
地址
模式
4F3(RA)
4F1(RA)
4F03
4F02
7 N -2
4
4F08
4F04
4F05
4F07
4F0F
4F0D
4F0E
数
钟
10 + 8 N
10 + 16 N
6
8
笔记
可中断
可中断
7
11
9
9
16 + 8 N
4
4
Priveleged
文档＃
MICRO-10
版本B
第34 6
