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AN231E04数据 - 动态可重构dpASP
引脚
针
号
1
2
3
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5
6
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38
39
针
名字
I1P
I1N
O1N
O1P
AVSS
O2P
O2N
I2N
I2P
AVDD
I3P
I3N
O3N
O3P
IO5P
IO5N
IO6P
IO6N
IO7P
IO7N
O4P
O4N
I4N
I4P
BVDD
VREFP
VMR
VREFN
BVSS
CFGFLGb
CS2b
CS1b
SCLK
ACLK
模式
DVDD
DVSS
SI
LCCb /
DOUT1
ERRB
激活
MEMCLK /
DOUT2
SO
RESETB
针
TYPE
+已经投入
-ve输入
-ve输出
+已经输出
供应地
+已经投入
-ve输入
-ve输出
+已经输出
正电源
+已经投入
-ve输入
-ve输出
+已经输出
+已经输入/输出
-ve输入/输出
+已经输入/输出
-ve输入/输出
+已经输入/输出
-ve输入/输出
+已经投入
-ve输入
-ve输出
+已经输出
正电源
参考负载
参考负载
参考负载
供应地
数字输出
数字输入
数字输入
数字输入
数字输入
数字输入
正电源
供应地
数字输入
数字输出
评论
类型1输入/输出单元。 （ IO单元1 ）
模拟或数字输入和输出引脚
模拟地， 0伏
类型1输入/输出单元。 （ IO单元2 ）
模拟或数字输入和输出引脚
模拟电源3.3伏特
Type1a输入/输出单元。 （ IO单元3 ）
模拟或数字输入和输出引脚
2型输入/输出单元。 （ IO单元5 ）
2型输入/输出单元。 （ IO单元6 ）
2a型输入/输出单元。 （ IO单元7 ）
Type1a输入/输出单元。 （ IO单元3 ）
模拟或数字输入和输出引脚
参考电压电源3.3伏特
参考电压噪声抑制。连接一个100nF的电容，每个引脚
到BVSS 。容性储用于吸收和源的峰值电流，因而
减少噪声并保持稳定的参考电压。
电压参考地0伏
配置状态引脚。开漏输出与可选的内部上拉电阻。该
输出电压也被检测到内部电路，原理图见图XX 。
片选引脚
设备选择
CMOS ，配置逻辑选通时钟。
CMOS ，模拟时钟输入
连接到VSS （ ACLK和SCLK外部来源） 。
连接到VDD （ ACLK源自外部， MEMCLK & SO内部产生） 。
数字电源3.3伏特
数字地面0.0伏特
CMOS串行数据输入。
CMOS 。默认的功能，表示本地配置完成。
可选功能（仅单dpASP外观设计） ，引脚可配置为用户
在软件控制下可分配的信号路径的数字输出。
错误指示。
开漏输出，外接上拉电阻，必须使用（ 10KOhms ）见图XXA
显示设备激活。开漏输出与可选的内部上拉电阻。
输出电压也被检测到内部电路，原理图见图XX 。
输出MEMCLK时钟时， MODE引脚= VSS 。
注意 - 不要装入复位时该引脚（不被外部拉低）
串行输出，仅作为配置过程中的SPI- PROM设置字节的输出。
连接到VSS重置dpASP 。如果保持低的dpASP将保持在复位
（ 2毫秒的延迟内部设定时间如下RESETB （释放时，该引脚被拉低
高） ）
40
41
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43
44
数字输出
数字输出
数字输出
数字输出
数字输入
DS231000-U001d
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