PE
Q0
Q
P1
P2
P3
SLAVE
主
Q1
Q
SLAVE
主
Q2
Q
SLAVE
Q3
主
P0
Q
Q
Q
MR
Q
Q
Q
Q
CE
CP
TC
注意，此图仅用于提供逻辑操作的理解。它不应该被用于评估
传播延迟尽可能多门功能在内部实现，而不会产生一个完整的门延迟。
MC10H016
图2： 4位二进制计数器逻辑图
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Q0Q3
PE
CE
MR
Tc
C
Tc
C
MR
Tc
PE
CE
PE
4
Q0Q3
P0P3
1/2 10H109
P0P3
1/2 10H109
Q0Q3
Q0Q3
CE
MR
C
Tc
PE
Q0Q3
FO
CE
MR
C
PE
CE
MR
最低位
最高位
Tc
C
P0P3
P0P3
1/2 10H109
1/2 10H109
P0P3
时钟
PN
计数器5月一日至16日
MC10H016级联5级预置计数器
最大频率。低于最大单独计算时只或门延迟。
