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ST7263BDx ST7263BHx ST7263BKx ST7263BE
通信接口特性
（续）
图73.典型应用有我
2
C总线和时序图
1)
V
DD
4.7k
I
2
C总线
4.7k
V
DD
100
100
SDAI
SCLI
ST72XXX
重复START
开始
t
SU（ STA ）
SDA
t
W（ STO ： STA ）
开始
t
F（ SDA）
SCK
t
R（ SDA ）
t
SU（ SDA ）
t
H（ SDA ）
停止
t
小时（ STA）的
t
W（ SCKH ）
t
W（ SCKL ）
t
R（ SCK ）
t
F（ SCK ）
t
SU（ STO ）
注意：
1.测量点在做CMOS电平： 0.3xV
DD
和0.7xV
DD
.
下面的表给出的值被写入在
该I2CCCR寄存器以获得所需的I
2
C
SCL线频率。
表28. SCL频率表
I2CCCR价值
f
SCL
（千赫）
400
300
200
100
50
20
f
中央处理器
= 4兆赫。
V
DD
= 4.1 V
R
P
= 3.3kΩ的
P
=4.7k
NA
NA
NA
NA
83h
83h
10h
10h
24h
24h
5Fh
5Fh
V
DD
= 5 V
R
P
= 3.3kΩ的
P
=4.7k
NA
NA
NA
NA
83h
83h
10h
10h
24h
24h
5Fh
5Fh
f
中央处理器
= 8兆赫。
V
DD
= 4.1 V
R
P
= 3.3kΩ的
P
=4.7k
83h
83
85h
85h
8Ah
89h
24h
23h
4Ch
4Ch
FFH
FFH
V
DD
= 5 V
R
P
= 3.3kΩ的
P
=4.7k
83h
83h
85h
85h
8Ah
8Ah
24h
23h
4Ch
4Ch
FFH
FFH
图例：
R
P
=外部上拉电阻
f
SCL
= I
2
C速度
NA =不实现
注意事项：
- 周边200 kHz的速度，实现速度可以有
±5%
公差
- 对于其他的速度范围，实现速度可以有
±2%
公差
上述变化取决于所使用的外部部件的精度。
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