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TMS320C6414 ， TMS320C6415 ， TMS320C6416
定点数字信号处理器
SPRS146L
2001年2月
经修订的2004年7月
多通道缓冲串行端口（ McBSP的）时间
为McBSP的时序要求
（参见图51）
号
5E0,
A5E0,
6E3,
A6E3,
7E3
民
2
3
5
6
7
8
10
11
单位
最大
t
C（ CKRX ）
t
W（ CKRX ）
t
SU（ FRH - CKRL ）
t
H（ CKRL - FRH ）
t
SU（ DRV- CKRL ）
t
H（ CKRL - DRV ）
t
SU（ FXH - CKXL ）
t
H（ CKXL - FXH ）
周期时间， CLKR / X
脉冲持续时间， CLKR / X高或CLKR / X低
建立时间前CLKR低外部FSR高
时间，
CLKR低后保持时间外部FSR高
时间，
建立时间DR前CLKR低有效
时间，
保持时间DR CLKR低后有效
时间，
前CLKX低设置时间外部FSX高
时间，
CLKX低后保持时间外部FSX高
时间，
CLKR / X EXT
CLKR / X EXT
CLKR INT
CLKR分机
CLKR INT
CLKR分机
CLKR INT
CLKR分机
CLKR INT
CLKR分机
CLKX INT
CLKX分机
CLKX INT
CLKX分机
4P或
9
1.3
6
3
8
0.9
3
3.1
9
1.3
6
3
6.67
§
ns
ns
ns
ns
ns
ns
ns
ns
0.5t
C（ CKRX ）
1
#
CLKRP = CLKXP = FSRP = FSXP = 0。如果任何信号的极性反转，然后该信号的定时基准，也反转。
最低CLKR / X周期
必须
得到满足，即使是由一个内部时钟源产生CLKR / X 。最低CLKR / X的周期时间是
内部逻辑速度;最大可用速度可能会低于由于EDMA限制和AC时序要求。
§
P = 1 / CPU时钟频率纳秒。例如，在600 MHz的运行部件时，使用P = 1.67纳秒。
无论使用何种值越大。
#
此参数适用于最大McBSP的频率。操作串行时钟（ CLKR / X） ，在合理范围内的40/60占空比。
116
邮政信箱1443
休斯敦，得克萨斯州77251-1443
