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HYS72D[32/64/128]3[00/20]GBR
录得双数据速率SDRAM模块
引脚配置
2
引脚配置
表3
针＃名称
125
29
122
27
141
118
115
A6
A7
A8
A9
A10
AP
I
I
I
I
NC
I
I
NC
I
I
I
SSTL
SSTL
SSTL
SSTL
SSTL
SSTL
SSTL
–
SSTL
SSTL
SSTL
时钟信号
补钟
时钟使能等级0
时钟使能等级1
注： 2级模块
NC
注意：
1-rank
模块
序号为0的片选
等级1的片选
注： 2 -行列模块
NC
注： 1级模块
行地址选通
列地址
频闪
写使能
NC
NC
–
167
NC
A13
NC
I
–
SSTL
A11
A12
RDIMM的引脚配置
（续）
针
缓冲功能
类型类型
I
I
I
I
I
I
I
I
SSTL
SSTL
SSTL
SSTL
SSTL
SSTL
SSTL
SSTL
地址信号12
注意：模块的基础上
256 MB或更大
模具
注： 128 Mbit的基础
模块
地址信号13
注： 1基于千兆
模块
注意：模块的基础上
512 MB或
小模
地址总线11：0
注册DDR SDRAM的引脚配置
DIMM是在列出的功能
表3
（ 184针） 。该
列引脚和缓冲器类型使用的缩写
在解释
表4
和
表5
分别。引脚
编号是在描绘
图1 。
表3
针＃名称
时钟信号
137
138
21
111
CK0
CK0
CKE0
CKE1
RDIMM的引脚配置
针
缓冲功能
类型类型
控制信号的
157
158
S0
S1
154
65
63
10
RAS
CAS
WE
我重置
LV-
寄存器复位
CMOS强制注册
输入低
注：有关详细
的描述
电和
动力
管理见
应用程序
注意在年底
数据表
地址信号
59
52
48
43
41
130
37
32
BA0
BA1
A0
A1
A2
A3
A4
A5
I
I
I
I
I
I
I
I
SSTL
SSTL
SSTL
SSTL
SSTL
SSTL
SSTL
SSTL
地址总线11：0
银行地址总线
1:0
地址总线11：0
数据表
8
修订版1.1 ， 2004-04
10102003-01E2-HPA8
