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HYS72D[32/64/128]3[00/20]GBR
录得双数据速率SDRAM模块
SPD内容
表13
SPD代码HYS72D128320GBR - 5 ， HYS72D643 [ 00/20 ] GBR -5和HYS72D32300GBR - 5
HYS72D128320GBR–5–B
HYS72D64300GBR–5–B
HYS72D64320GBR–5–B
HYS72D32300GBR–5–B
256 MB
×72
1级
修订版0.0
（十六进制）
0E
04
1C
01
02
26
C1
60
50
75
50
3C
28
3C
28
40
60
60
40
40
00
37
修订版1.1 ， 2004-04
10102003-01E2-HPA8
产品类型&组织
1千兆字节
×72
2点
PC3200R–30331
（十六进制）
0E
04
1C
01
02
26
60
50
512 MB
×72
1级
PC3200R–30330
修订版0.0
（十六进制）
0E
04
1C
01
02
26
C1
60
50
75
50
3C
28
3C
28
80
60
60
40
40
00
37
512 MB
×72
2点
修订版0.0
（十六进制）
0E
04
1C
01
02
26
C1
60
50
75
50
3C
28
3C
28
40
60
60
40
40
00
37
标签代码
BYTE ＃
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
33
34
35
36 - 40
41
描述
突发长度
支持
多家银行上
SDRAM设备
CAS延迟
CS延迟
写入延迟
DIMM属性
TCK @ CLmax -0.5
（ 18字节） [ NS ]
TAC SDRAM @
CLmax -0.5 [ NS ]
PC3200R - 30330 PC3200R - 30330
JEDEC SPD修订版本1.0
组件的属性C0
TCK @ CLmax -1 （ 75字节
18 ） [ NS ]
TAC SDRAM @
CLmax -1 [ NS ]
tRPmin [ NS ]
tRRDmin [ NS ]
tRCDmin [ NS ]
tRASmin [ NS ]
每个模块密度
秩
TAS， TCS [ NS ]
TAH ， TCH [ NS ]
TDS [ NS ]
TDH [ NS ]
未使用
tRCmin [ NS ]
50
3C
28
3C
28
80
60
60
40
40
00
37
数据表
27
