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体系结构框图
1.4结构框图
注意：
斜体特点是不是在56F8122设备可用，为灰色，如下图所示。
该56F8322 / 56F8122结构如图
图1-1
和
图1-2 。图1-1
说明了
56800E系统总线与内部存储器和IPBus桥通信。
表1-2
列出
在56800E架构内部总线，并提供了它们的功能的简要说明。
图1-2
示出了连接到IPBus桥的外围设备和控制块。这些数字不显示
板上稳压器与电源和接地信号。他们也没有显示之间的复
外围设备或专用的GPIO 。请参阅
第2部分信号/连接说明，
看哪个
信号被复用的那些的其他外围设备。
中也显示
图1-2
是间的连接
PWM ，
定时器C和ADC模块。这些
连接允许的
PWM和/或
定时器C来控制ADC的转换开始的定时。该
定时器C ，通道2 ，输出可以产生周期性的启动（SYNC）信号提供给ADC来启动它的转换。
在另一种操作模式下， PWM负载中断（同步输出）信号在内部路由到定时器
C，信道2 ，输入所指示的。计时器可以用来之前引入一个可控延迟
产生其输出信号。定时器输出则触发ADC。
为了充分了解这种互动，
请参阅
56F8300外设用户手册
为澄清关于所有这三种操作
外设。
56F8322技术数据，第16
飞思卡尔半导体公司
初步
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