图4 - 典型数据总线输出延迟
与
容性负载（ TDDW ）
600
“ LO
图5 - 典型读/写， VMA和地址
输出延迟
与
容性负载（ TAD ）
600
“ LO
500
我OH
=-205A
最大@ 2.4 V
罗H=-145*max@2.4V
L=l.6mAmax@0.4v
L=l.6mAmax@0.4V
500 - VCC = 5.0V
1A = 25°C
~
=
u
z
F
＆ GT ;
~
:
400
z
u
z
/
/
200
-
100
/
CL
包括杂散电容
0’
0
100
200
CL ，
LOAO
300
电容
-VCC=5.OV
TA =
25°C
-$
,:,
400
300
~
/
‘
/
~
~
~
u
0
300
200
100
CL
包括杂散电容
600
o
0
100
400
（PF ）
500
2og~+~~
， I $ OO
400
500
600
摩托罗拉
@
半导体
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