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莱迪思半导体公司
主时钟布线
架构
LA- LatticeXP2系列数据表
在LA- LatticeXP2器件的时钟布线结构由八个主时钟线网（ CLK0
通过CLK7 ）每个象限。由位于中心复用器产生每个象限的主时钟
该装置。所有的时钟源被连接到这些多路复用器。图2-9显示了时钟布线一个四核
咆哮。每个象限多路复用器是相同的。如果需要的话，任何时钟可全局路由。
图2-9 。每个象限主时钟选择
主时钟源：锁相环+ CLKDIVs +的PIO +路由
30:1
30:1
30:1
30:1
30:1
30:1
29:1
29:1
29:1
29:1
DCS
CLK0
CLK1
CLK2
CLK3
CLK4
CLK5
CLK6
DCS
CLK7
8
主时钟（ CLK0到CLK7 ）每个象限
动态时钟选择（ DCS ）
DCS的是在主时钟的路由提供了智能多路转换器的功能。它切换两个独立的
输入时钟源，没有任何毛刺或欠幅脉冲。当选择信号是这是不论取得
切换。有每个象限2的DCS块;总体而言，每台设备8 DCS块。输入到DCS块
来自中心复用器。 DCS的输出被连接到主时钟CLK6及CLK7 （见图2-
9).
图2-10显示了默认的DCS操作模式的时序波形。在DCS模块进行编程
到其它模式。有关DCS的更多信息，请参见TN1126 ，
的LatticeXP2 SYSCLOCK PLL设计和
使用指南
.
图2-10 。 DCS波形
CLK0
CLK1
SEL
DCSOUT
辅助时钟/控制路由
在LA- LatticeXP2器件辅助时钟基于区域的资源。基于区域的资源的好处科幻吨
是相对低的喷射延迟和区域内的偏斜相比，主时钟。 EBR行， DSP
行和专门的垂直路由通道结合的第二个时钟的区域。这种特殊的垂直布线信
NEL对准中心的DSP块的DSP的行中的任一的左边缘或在DSP行的中心。图2-
11显示了这个特殊的垂直布线通道和六个二级时钟区域的LA- LatticeXP2-17 。所有LA-
2-12
