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PACE1750AE
接线端子
案例概述：针脚栅格阵列（案例Z）
终奌站
数
B1
B2
C1
C2
D1
D2
E1
E2
F1
F2
G1
G2
H1
H2
J1
J2
K1
L2
K2
L3
K3
L4
K4
终奌站
符号
V
CC
IB
14
IB
13
IB
12
IB
11
IB
10
IB
9
IB
8
GND
IB
7
IB
6
IB
5
IB
4
IB
3
IB
2
IB
1
IB
0
GND
UNRCV ER
定时器CLK
NML PWRUP
RESET
TRIGO RST
终奌站
数
L5
K5
L6
K6
L7
K7
L8
K8
L9
K9
L10
K11
K10
J11
J10
H11
H10
G11
G10
F11
F10
E11
E10
终奌站
符号
DMA EN
CON REQ
V
CC
SNEW
总线锁定
总线GNT
总线忙
M / IO
D / I
读/写
GND
RDYD
RDYA
公交REQ
STRBD
什特尔巴
CPU CLK
AK
0
AK
1
AK
2
AK
3
GND
AS
0
终奌站
数
D11
D10
C11
C10
B11
A10
B10
A9
B9
A8
B8
A7
B7
A6
B6
A5
B5
A4
B4
A3
B3
A2
终奌站
符号
AS
1
AS
2
AS
3
IOL
2
INT
V
CC
GND
IOL
1
INT
USR
5
INT
USR
4
INT
USR
3
INT
USR
2
INT
USR
1
INT
USR
0
INT
PWRDN INT
GND
少校ER
SYSFLT
1
SYSFLT
0
EXT ADR ER
MEM PAR ER
MEM PRT ER
IB
15
文档＃
MICRO-2
版本G
第16页25
