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CYIWOSC3000AA
PULLDIR确定可选的上拉电阻器的方向。 0 =下拉， 1 =上拉。
该PULLENB位使能片上上拉或下拉电阻。如果上拉或下拉选择PULLDIR选择。
DRV选择输出驱动器的驱动强度。 0 = 8毫安标称驱动器， 1 = 2 mA低功耗驱动器。 2- mA驱动强度
建议保持低功耗。
的VSEL位必须被编程以匹配的Vddio被连接到电源。如果Vddio都连接到1.8V电源，
然后VSEL必须用0.如果编程的Vddio被连接到一个2.8至3.3V电压，然后VSEL必须用1编程。
8.2.38
位＃
I
2
CIO(61)
名字
DIR
默认
功能
7
6
5
4
3
2
1
0
PDIRA3
PEA3
保持
PULLDIR
PULLENB
DRV
VSEL
R
RW
RW
RW
RW
RW
RW
RW
0
0
1
0
1
1
1
0
版权所有
0 = SBIA3拉下来
1 = SBIA3拉升
0 =禁用拉SBIA3上/下
1 =使能上拉/下拉上SBIA3
0 =禁用总线保持在SDAT
1 =启用总线保持在SDAT
0 =下拉上SCLK ， SDAT
1 =拉起SCLK ， SDAT
0 =上拉/下拉电阻在SCLK ， SDAT关闭
1 =上拉/下拉电阻在SCLK ， SDAT启用
在SDAT 0 = 8 mA驱动
在SDAT 1 = 2 mA驱动
0 = 1.8V的Vddio上SDAT
1 =的Vddio 2.8-3.3V上SDAT
在我
2
CIO寄存器控制SBIA3 ， SCLK和SDAT我的IO引脚设置
2
的引脚。 SCLK和SBIA3输入专用管脚，但
每个引脚有它自己的控制位为一上拉或下拉电阻。 SCLK和SDAT共享相同的上拉/下拉控件。 SDAT
是双向销，并具有额外的2个控制位，用于选择在IO电压和驱动强度以及弱总线
守护者的功能。
8.2.39
位＃
PCLKIO(62)
名字
DIR
默认
功能
7
6
5
4
3
2
1
0
PULLDIR
PULLENB
DRV
VSEL
三态
保持
R
RW
RW
R
RW
RW
RW
RW
0
0
0
1
0
0
0
0
版权所有
0 = PIXCLK启用
1 = PIXCLK三态
0 =总线守护者禁用
1 =总线保持启用
版权所有
0 =下拉
1 =上拉
0 =上拉/下拉电阻禁用
启用1 =上拉/下拉电阻
在PIXCLK 0 = 8 mA驱动
在PIXCLK 1 = 2 mA驱动
0 = 1.8V的Vddio上PIXCLK
1 =的Vddio 2.8-3.3V上PIXCLK
该PCLKIO寄存器控制PIXCLK引脚的IO引脚设置。 PIXCLK能够以高达48 MHz的这样的单独控制操作
在IO端子的设置，以满足时序和驱动应用的强度需要。三态位三态PIXCLK
引脚。当PIXCLK为三态时， KEEP或PULLENB位必须设置或外部上拉电阻必须用于确保
这PIXCLK不浮动或销将利用多余的电能。该DRV和VSEL位选择的驱动强度和电压的Vddio
分别。
文件编号： 38-19009牧师* E
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