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TMS320C32
数字信号处理器
SPRS027C - 1995年1月 - 修订1996年12月
对于HOLD / HOLDA时序[P = T
C（H ）
] （见注6和图31 ）
号
NO
80
81
82
83
84
84.1
85
86
87
88
89
90
91
TSU （ HOLD ）
电视（ HOLDA ）
总重量（ HOLD ）
总重量（ HOLDA ）
td(H1L-SH)H
td(H1H-IOS)H
tdis(H1L-S)
ten(H1L-S)
tdis(H1L-RW)
ten(H1L-RW)
tdis(H1L-A)
ten(H1L-A)
tdis(H1H-D)
建立时间，在H1低HOLD
有效时间， HOLDA后H1低
脉冲持续时间， HOLD低
脉冲持续时间， HOLDA低
延迟时间， H1低到高STRBx为HOLD
延迟时间， H1高到IOSTRB高的HOLD
禁止时间， H1低到STRBx或IOSTRB （在
高阻抗状态）
启用时间， H1低到STRBx或IOSTRB活跃
禁用时间，H1低到中的R / W
高阻抗状态
使能时间中，H1低到R / W （有源）
禁止时间， H1低到A高阻抗
状态
启用时间， H1低到一个有效的
禁用时， H1高到D的禁用
高阻抗状态
’C32 - 40
民
13
0
2P
P – 5
0
0
0
0
0
0
0
0
0
9
9
9
9
9
9
10
13
9
最大
9
’C32 - 50
民
10
0
2P
P – 5
0
0
0
0
0
0
0
0
0
7
7
8
7
8
7
8
12
8
最大
7
’C32 - 60
民
8
0
2P
P – 5
0
0
0
0
0
0
0
0
0
6
6
7
6
7
6
7
11
7
最大
6
单位
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
从表征放心，但未经测试
§未测试
注6 ： HOLD是一个异步输入在一个时钟周期可以被断言在任何点。如果指定的定时被满足时，确切
显示顺序发生;否则，一个时钟周期的额外延迟可能发生。主比特控制寄存器的NOHOLD位
覆盖HOLD信号。
邮政信箱1443
休斯敦，得克萨斯州77251-1443
37
