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4兆位/ 8兆位LPC串行闪存
SST49LF004C / SST49LF008C
超前信息
固件存储周期
固件存储器读周期
表4 ：F
IRMWARE
M
埃默里
R
EAD
C
YCLE
F
屈服
D
EFINITIONS
时钟
周期
1
场
名字
开始
字段内容
LAD [ 3：0]
1
1101
LAD [ 3：0]
方向
IN
评论
LFRAME ＃必须有效（低）的部分回应。
只有最后开始字段（前LFRAME ＃转换为高）
将被识别。开始字段内容（ 1101B ） indi-
泄漏一个固件存储器读周期。
这表明
SST49LF00xC
设备应当回应。
如果IDSEL （ID选择）字段相匹配的ID的值[3： 0]，
然后该特定设备将到LPC总线响应
周期。
这些7个时钟周期构成的28位存储器
地址。 YYYY是整个报告的一四位。
地址传输时最显著四位。
该MSIZE字段指示有多少字节将反
在多字节操作ferred 。
设备将执行多字节读2-
MSIZE
字节。
SST49LF00xC
仅支持MSIZE = 0，1 ，2，4 ，7（1 ，2，4 ，
16 ， 128字节） ，与KKKK = 0000B ， 0001B ， 0010B ， 0100B ，或
0111b.
在这个时钟周期，主（英特尔ICH ）带动了公交车
到全'1' ，然后浮在总线之前，下一个时钟
周期。这是在总线的第一部分“转换周期”。
该
SST49LF00xC
在此需要对总线的控制
周期。
在该时钟周期中，该装置产生一个“准备同步”
（ RSYNC ），表明该装置已接收的输入
数据。最不显著字节的最低显著半字节
将在下一时钟周期是可用的。
A=(13+2
n+1
） ; N = MSIZE
最显著的半字节输出第一。
在该时钟周期中，所述
SST49LF00xC
驱动总线到所有
那些然后漂浮之前在下一个时钟周期的总线。
这是在总线的第一部分“转换周期”。
A=(13+2
n+1
） ; N = MSIZE
主机在这个周期重新开始对总线的控制。
A=(13+2
n+1
） ; N = MSIZE
T4.0 1292
2
IDSEL
0000 1111
IN
3-9
MADDR
YYYY
IN
10
MSIZE
KKKK
IN
11
TAR0
1111
IN，
然后浮
浮，
那么OUT
OUT
12
13
TAR1
rsync的
1111 （浮点）
0000 （ READY ）
14-A
(A+1)
数据
TAR0
ZZZZ
1111
OUT
OUT ，
然后浮
(A+2)
TAR1
1111 （浮点）
浮，
然后，在
1.字段内容是关于本时钟周期的上升沿有效。
LCLK
LFRAME ＃
开始
IDSEL
MADDR
A[7:4]
A[3:0]
MSIZE
KKKKb
TAR0
1111b
TAR1
rsync的
D
0
[3:0]
D
0
[7:4]
数据
D
n
[3:0]
D
n
[7:4]
TAR
1292 F03.0
LAD [ 3：0]
1101B 0000B A [ 27:24 ] A [ 23点20分] A [ 19:16] A [ 15:12] A [ 11 ： 8 ]
三州0000B
图5 ：F
IRMWARE
M
埃默里
R
EAD
C
YCLE
W
AVEFORM
200了Silicon Storage Technology ， Inc.的
S71292-00-000
1/06
13
