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XC164TM
衍生产品
电气参数
这对于使用等待状态，并如总线周期尤为重要供的操作
定时器，串行接口等。对于所有慢速操作或较长周期（如脉冲序列
产生或测量，较低波特率等）所造成的锁相环的抖动偏差
是微不足道的。
PLL的累积抖动值取决于连续VCO的数
相应的时间内输出循环。 VCO输出的时钟是由分
输出分频器（K = PLLODIV + 1 ）产生主时钟信号
f
MC
。因此，
压控振荡器的周期数可以表示以K
×
N,
哪里
N
是数
连续
f
MC
周期（ TCM） 。
一段
N
×
中医累积PLL抖动的偏差D定义
N
:
D
N
[ NS ] =
±(1.5
+ 6.32
×
N
/
f
MC
);
f
MC
在[兆赫]
N
=连续的中药数量。
所以，在一段3中药@ 20兆赫和K = 12 ：D
3
=
±(1.5
+ 6.32
×
3
/ 20 ）= 2.448纳秒。
这个公式是适用在K
×
N
< 95.对于长时间在K
×
N
= 95的值可以是
使用。这个稳定值可以近似由：D
n最大
[ NS ] =
±(1.5
+ 600 / (K
×
f
MC
)).
命中率。抖动
D
N
ns
±8
±7
±6
±5
±4
±3
±2
±1
0
0 1
5
40 MHZ
10兆赫
K = 12
K=8
K=6 K=5
K = 15 K = 10
20兆赫
10
15
20
25
N
MCD05566
图4-6
近似的累积PLL抖动
注意：粗体线表示其可以通过以下方式实现的最小累积抖动
选择最大可能的输出的分频因子K.
数据表
57
V1.0, 2005-11
