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CY7C4425/4205/4215
CY7C4225/4235/4245
架构
该CY7C42X5由64的阵列，以18的4K字
每个比特（由SRAM单元的双端口阵列实现的） ，一个
读指针，写指针，控制信号（ RCLK ， WCLK ，
任，文， RS ） ，和标志（ EF ， PAE ， HF ， PAF ， FF ） 。该
CY7C42X5还包括控制信号WXI ， RXI ， WXO ，
RXO的深度扩展。
表1.写偏移寄存器
LD
0
文
0
WCLK
[36]
选择
写偏移寄存器：
空偏移
全偏移
无操作
写入FIFO
无操作
0
1
1
0
1
复位FIFO
在上电时，在FIFO必须用复位来复位（RS）
周期。这使得FIFO进入空状态显
由EF为低nified 。后所有数据输出变为低电平
遥感只有当OE置位下降沿。为了在FIFO
重置为其默认状态，下降沿必须发生在RS
并且用户不能读取或写入，而RS为低。
1
FIFO操作
当文信号有效（低电平） ，存在于数据
D
0–17
销被写入FIFO上的每个上升沿
WCLK信号。类似地，当REN信号是低电平有效，
在FIFO存储器中的数据将在Q上呈现
0–17
OUT-
放。新的数据将在RCLK的每个上升沿介绍
而任志强为低电平有效， OE是低电平。任志强必须建立
RCLK前几十它是一个有效的读取功能。文绝
WCLK之前发生的几它是一个有效的写功能。
输出使能（ OE ）引脚提供给三态的Q
0–17
输出时， OE为无效。当OE启用（ LOW ）
在输出寄存器中的数据将提供给Q
0–17
输出
吨后
OE
。如果设备级联时， OE功能仅
上被读使能FIFO的输出数据。
FIFO中包含溢出电路不允许附加
当写入FIFO满，和下溢电路不允许
另外，当读取FIFO为空。 FIFO为空
保持在其Q的最后一个有效读出的数据
0–17
输出
即使额外的读取发生。
注意：
36.同样的选择顺序适用于从寄存器中读取。任
启用并读取RCLK的低到高的跳变进行。
标志操作
该CY7C42X5设备提供五旗引脚来指示
的FIFO内容的条件。空和满是同步的
知性。 PAE和PAF是同步的，如果V
CC
/ SMODE被绑定到
V
SS
.
满标志
的满标志（ FF）将变为低电平时，器件的完整。写OP-
操作被禁止，只要FF是低不管
温状态。 FF同步到WCLK ，也就是说，它是exclusive-
由WCLK的每个上升沿光年更新。
空标志
空标志（ EF）将变为低电平时，该设备是空的。
读操作被禁止，只要EF为低，顾及─
任少的状态。 EF是同步的RCLK ，即，它是
只更新由RCLK的每个上升沿。
可编程几乎空/几乎满标志
该CY7C42X5功能可编程几乎空和AL-
最全的标志。每个标志可被编程（描述于
编程部分）从它对应一个特定的距离
应的边界标志（空或满） 。当FIFO CON-
tains为其标志有字或更少的数量
编程时， PAF或PAE将被认定，表示
该FIFO或者是几乎完全或几乎空无一人。看
表
2
为可编程标志的说明。
当SMODE引脚接低电平时， PAF标志信号跃迁
灰是由写入时钟和PAE的上升沿
标志过渡由读时钟的上升沿引起的。
程序设计
该CY7C42X5器件包含两个12位偏移寄存器。
在D数据存在
0–11
在程序写入将确定
从空（满）的近空（差不多的距离
满）标志被激活。如果用户选择不编程
FIFO中的标志，缺省偏移值（见
表2）。
当负载LD引脚设置为低电平，闻置为低电平，数据
在输入端D
0–11
被写入到空的偏移值寄存器上
写时钟（ WCLK ）的头低到高的转变。
当LD引脚和温保持低电平，然后将数据写入
入全抵消在第二低到高的转录注册
习得的写时钟（ WCLK ）的。写的第三过渡
时钟（ WCLK ）再次写入空偏移寄存器（见
表1）。
写入所有偏移寄存器不必发生在
一度。一个或两个偏移量寄存器可以被写入，然后
通过将LD引脚为高电平时，FIFO将恢复正常
读/写操作。当LD引脚设置为低电平，而文
为低电平时，在下一个偏移值寄存器中顺序写入。
的偏移寄存器中的内容可以被读取到输出
当LD引脚设置为低电平，并任置为低电平线;那么，
数据可以读出在读的低到高的转变
时钟（ RCLK ） 。
重发
传输的数据包时，重发的功能是有益的
的数据。它使数据的接收到由被确认
在接收器和重传，如果有必要的。
重传（ RT ）输入有效的独立和宽度
扩张模式。重发功能是为使用
当一个数写入的等于或小于的深度
自从上次的RS循环的FIFO时有发生。在高脉冲
RT复位内部读出指针到第一物理位置
FIFO的。 WCLK和RCLK可以自由运行，但必须
期间和T被禁用
RTR
后重发脉冲。同
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