CDC208
双1号线到4线时钟驱动器
具有三态输出
SCAS109F - 1990年4月 - 修订1998年10月
D
D
D
D
D
D
D
低抖动传输延迟
规格为时钟驱动器
应用
TTL兼容的输入和
CMOS兼容输出
流通型架构能够优化
PCB布局
中心引脚V
CC
和GND引脚
配置最小化高速
开关噪声
EPIC
（增强型性能注入
CMOS ） 1微米工艺
500 - mA典型闭锁抗扰度在
125°C
封装选择包括塑料
小外形（ DW ）
DW包装
（ TOP VIEW ）
1Y2
1Y3
1Y4
GND
GND
GND
GND
2Y1
2Y2
2Y3
1
2
3
4
5
6
7
8
9
10
20
19
18
17
16
15
14
13
12
11
1Y1
1A
1OE1
1OE2
V
CC
V
CC
2A
2OE1
2OE2
2Y4
描述
该CDC208包含双时钟驱动器电路是扇出一个输入信号到四个输出端与最小歪斜
对于时钟分布（参见图2） 。该器件还提供了两个输出使能（ OE1和OE2 ）输入每个
电路，它可以强制输出被禁用，以一个高阻抗状态，或一个高或低逻辑电平
独立于各自的A输入的信号。
歪斜参数被指定为通用于许多应用中降低的温度和电压范围。
该CDC208的特点是操作从 - 40 ° C至85°C 。
功能表
输入
1OE1
L
L
L
H
H
1OE2
L
L
H
L
H
输入
2OE1
L
L
L
H
H
2OE2
L
L
H
L
H
2A
L
H
X
X
X
2Y1
L
H
L
H
Z
1A
L
H
X
X
X
1Y1
L
H
L
H
Z
输出
1Y2
L
H
L
H
Z
1Y3
L
H
L
H
Z
1Y4
L
H
L
H
Z
输出
2Y2
L
H
L
H
Z
2Y3
L
H
L
H
Z
2Y4
L
H
L
H
Z
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