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a
主要特点
250兆赫， 4.0 ns指令周期率
内部-片上SRAM内存6M位
19 19毫米（ 484球）或27 27毫米（ 625球） PBGA
包
双路计算模块，每个都包含一个ALU，一个
乘法器，一个移位器和寄存器文件
双整数ALU的，提供数据寻址和
指针操作
集成I / O包括14通道DMA控制器，
外部端口，四端口链路， SDRAM控制器，
可编程标志引脚，两个定时器，和定时器
过期引脚为系统集成
IEEE 1149.1兼容的JTAG测试访问端口进行
片上仿真
片内仲裁的无胶合多用
多达八个的TigerSHARC
在一个普通的总线的DSP
微电脑DSP
ADSP-TS101S
重点班妮科幻TS
提供高性能的静态超标量DSP
操作，优化电信
基础设施建设等大，要求
多处理器DSP应用
性能十分出色的DSP算法和I / O
基准（见基准测试中
表1
和
表2）
支持低开销DMA传输之间
内部存储器，外部存储器，存储器映射
外设连接端口，主机处理器和其他
（多处理器）的DSP
简化DSP编程通过非常灵活
指令集和高级语言友好DSP
架构
支持可扩展的多处理系统，具有低
通信开销
T
功能框图
计算功能块
移
程序定序
PC
BTB
IRQ
数据的地址生成
整
ALU
32x32
32
32
整
ALU
32x32
内部存储器
内存
M0
64Kx32
A
D
内存
M1
64Kx32
A
D
内存
M2
64Kx32
A
D
JTAG端口
6
ALU
倍增器
IAB
ADDR
取
SDRAM控制器
32
X
注册
网络文件
32x32
128
DAB
128
128
128
M0 ADDR
M0数据
外部端口
多
接口
32
主机接口
32
M1 ADDR
M1数据
输入FIFO
ADDR
64
数据
输出缓冲器
DAB
128
128
32
128
M2 ADDR
OUTPUT FIFO
M2数据
I / O地址
I / O处理器
DMA
调节器
DMA地址
ALU
控制/
状态/
的TCB
DMA数据
32
256
256
链路端口
调节器
链接
端口
控制/
状态/
缓冲器
L2
L0
32
CLUSTER BUS
ARBITER
CNTRL
Y
注册
网络文件
32x32
倍增器
3
8
3
L1
LINK DATA
3
8
3
L3
8
8
移
TigerSHARC系列和TigerSHARC系列徽标是ADI公司的商标。
第0版
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ADI公司， 2002年
