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数据表
1999年6月
ORCA
2系列的FPGA
I.
四TRIDIH缓冲区允许的连接
焊盘到PLC XH线。该TRIDIHs还允许
PLC中的XH线和之间的连接
pBIDIH线，其中描述了
K
下文。
J.
该PBIDI线（比迪[3： 0]）连接PXL线，
PXH线和PX1线。这些都是双向
tional在于，所述路径可以是从PXL ， PXH ，或
PX1线对XL线，或从XL线的
PXL ， PXH ，或PX1线。
K.
该pBIDIH线（ BIDIH [3： 0]）连接PXL
线， PXH线和PX1线。这些都是bidi-
rectional在于，所述路径可以是从PXL ， PXH ，
或PX1线到XH线，或从XH线
在PXL ， PXH ，或PX1线。
L.
该蚊帐[ 3 ： 0 ]线提供了从快速连接
在I / O焊盘到XL和XH线。
M.This
集CIPS允许八个X1线（ 4对
PLC中的每一侧上）垂直于所述的PIC为
连接到无论是在PIC的PX1和PX2线。
N.
这套CIPS允许八个X4线（ 4对
PLC中的每一侧上）垂直于所述的PIC为
连接到PX1线。这允许快速访问
到/从I / O焊盘从/到PLC 。
O.
所有四个组中的PLC的X4线连接到所有
通过四个相邻PLC可编程控制器X4线
一个CIP （这不同于
ORCA
1C系列中
.
这在相邻的PLC的X4线的两个是
直接连接，无需任何CIPS ）。
P
长线路驱动器（ LLDRV ）线可以通过驱动
.
在XSW4开关线相邻的PLC 。要亲
韦迪连接到焊盘，所述LLDRV线可以
也连接到任何四个PXH或对中的一个
PXL线。三态使能（ TS [I ] ）的所有四个I / O
垫可通过XSW4 ， PXH ，或PXL线来驱动。
Q.
对于快速时钟布线，在四个I / O焊盘1
每个PIC的，可以选择要被驱动到一个专用
cated时钟线。时钟线跨越的长度
在PLC阵列（宽度） 。这种专用的时钟线为
典型地用作一个时钟脊柱。在PLC上，
脊柱连接到XL线提供一个时钟
分支中的垂直方向。由于存在
在PIC另一个时钟线路上的相对侧
在阵列中，只有一个给定行中1的I / O焊盘
（列）可用于在产生一个全局信号
这样，如果所有的PLC通过信号驱动。
可编程输入/输出单元格
（续）
PIC建筑描述
在图26中给出的PIC的体系结构进行说明
使用下面的字母标记。在网络连接gure描绘
与PIC在阵列的顶部，所以间的PIC路由是贺 -
izontal和间接PIC -PLC的路由是水平的，以
垂直的。在某些情况下，字母中更设有
多个位置以指示线的路径。
A.
如在PLC上，在PIC中包含的一组线中的哪
运行该数组的长度（宽度） 。该PXL线
连接在该阵列的其他PXL的角
线。该PXL线还连接到PIC BIDI ，
PIC BIDIH和LLDRV线。如在PLC XL线
在PXH线扭曲，因为他们通过传播
太平洋岛国。
B.
如在PLC上，在PIC中包含的一组线中的哪
运行的二分之一的阵列的长度（宽度） 。该PXH
线连接在弯道和的中间
阵列周边其他PXH线。该PXH线
也连接到PIC BIDI ， PIC BIDIH和
LLDRV线。如在PLC中的XH线， PXH线
不扭曲，因为他们通过太平洋岛国传播。
C.
该PX2 [ 3 ： 0 ]线跨越两个岛国之前的长度
用CIP的CIP相交允许的长度
.
使用PX2线的路径将延长2照片。
D.
该PX1 [ 3 ： 0 ]线跨前一间单独的PIC
与CIP的CIP secting允许的长度
.
使用PX1线路径由一个知情同意进行扩展。
E.
这是四个专用的直接输出线CON组
，连接到该输出缓冲器。在DOUT [3： 0]信号
直接由PLC锁定/ FF去一个输出缓冲，
最小化的闩锁/ FF到垫的传播延迟。
F.
这是从输入焊盘到PLC的直接路径
锁存器/触发器中的两行（列）相邻的
太平洋岛国。该输入允许减少设置时间。直接
从顶部和底部的PIC行输入是
PDINTB [3：0 ] 。由左和右直接输入
PIC的列是PDINLR [3：0 ] 。
G.
此外，OUT [3： 0]， TS [3：0 ]和IN ：为每个[ 3：0 ]信号
I / O焊盘可以被直接路由到相邻的PLC的
切换线路。
H.
四TRIDI缓冲区允许的连接
焊盘到PLC XL线。该TRIDIs还允许
在PLC XL线和之间的连接
PBIDI线，其中描述了
J
下文。
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