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ORCA
2系列的FPGA
数据表
1999年6月
可编程逻辑单元
(续) )
COUT
携带
A4
A4
A3
A2
A1
QLUT3
F3
A3
A2
A1
C
WD3
携带
D3
Q3
REG3
SR
EN
A3
A2
A1
A0
A0
PFU_NAND
C
F2
O4
D2
WD2
Q2
QLUT2
A4
携带
O3
REG2
C
SR
EN
O2
O1
B4
B4
B3
B2
B1
QLUT1
PFU_MUX
F1
D1
Q1
B3
B2
B1
C
WD1
REG1
SR
EN
O0
携带
PFU_XOR
F0
B3
B2
B1
B0
CIN
C0
LSR
GSR
WD [3:0 ]
CK
CKEN
三
B0
C
QLUT0
WD0
D0
Q0
T
T
B4
REG0
T
SR
EN
T
C
C
T
T
C
C
T
C
T
C
5-4573(F)
键: C =由CON组fi guration RAM控制。
图3.简化的PFU图
图2和图3示出了高级别和详细
意见在PFU ,分别港口。端口
用两都参考四字SUF网络X到
PFU的位置。如所提到的,有两个5位的输入
数据总线(A [4:0 ]和B [4 :0])到LUT ,一个4位
输入数据总线(WD [3: 0])到锁存器/ FFs的,并且一个
输出数据总线(O [4: 0])。
图3示出了四个锁存器/ FFs的( REG [ 3:0] )和
64位的查找表( QLUT [3: 0])中的PFU 。在PFU
确实组合逻辑在LUT和顺序
逻辑中的锁存器/ FFs的。 LUT是静态随机
存取存储器(SRAM) ,可用于读/
写或只读存储器。八个三态缓冲器
在每个PLC中也显示,虽然他们气动执行
盟友位于外部的PFU 。
每个锁存器/ FF可以接受的LUT数据。 Alterna-
疑心,锁存器/ FFS不能接受直接数据
WD [3:0 ] ,从而消除了LUT的延迟,如果没有组合
功能是必要的。该LUT输出可以绕过
锁存器/ FFs的,这减少了延迟出PFU的。它
可以使用的LUT和锁存/ FFs的更多或
少独立。例如,锁存器/ FFs的能
作为4位的移位寄存器,并且所述查找表可以是
用于检测当一个寄存器都有一个特定的图案
在它。
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