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ORCA
2系列的FPGA
数据表
1999年6月
可编程逻辑单元
（续）
上
地址
位
地址
解码
LUT1
BANK_EN1
WPE
DI
WR
4
DO
BIDI
16 ×4的RAM +
4缓冲器/ PFU
4
上
地址
位
地址
解码
LUT2
BANK_EN2
DOUT
WPE
DIN
WR
CLK
4
DI
WR
DO
4
BIDI
16 ×4的RAM +
4缓冲器/ PFU
5-4640(F)
注：低地址位未示出。
图16.同步RAM与写端口使能（ WPE ）
为了增加超过16 （例如， 32×记忆单词的深度
4 ），两个或多个PLC都可以使用。的地址和
写数据输入，用于所述两个或多个PLC被拴
一起（逐位） ，并且将数据输出被路由
通过每个可用的4个3 statable比迪烟
PFU 。比迪烟的输出，然后绑在一起（由位
位） ，如图16所示。
3 statable比迪的控制信号，称作RAM
银行启用（ BANK_EN1和BANK_EN2 ） ，是cre-
从高位地址的译码ated 。拉姆
银行启用，然后用于使4位的数据从
一个可编程控制器上读出的数据（DOUT ）总线。
该系列2系列现在有一个新的功能，可用
能够在内存模式下每个PFU 。输入到这个
功能是将写使能（WE ）信号，并且将写
端口使能（ WPE ）的信号。写使能信号是
输入的A4 ，而写入端口使能输入的C0
或CIN 。一般地， WPE输入由同一驱动
RAM银行能够控制的比迪烟的每个信号
PFU 。
哪个银行的RAM数据写入的选择
不要求使用的LUT的其他PFU就能如
在以前的
ORCA
架构。这降低了num-
PFU就能完成的误码率要求的公羊大于16个字
深度。
特别使用这种方法可以增加字
深入到32个字。由于两个WPE输入到
RAM和三态输入到BIDI可以
反转时，所述一个高位地址比特的解码是不
所需。取而代之的是，银行使能信号为两
银行绑在高地址位，用WPE
和三态输入高电平有效的一个银行和主动 -
低为其他。
增加内存的字的大小（如16 ×8 ） ， 2
或多个PLC被再次使用。地址，直写
能和PLC的写使能端口绑
一起（逐位） ，并且该数据是对每一个不同的
PLC 。增加这两个地址位置和字
尺寸是通过使用这些的组合来实现
两种技术。
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