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数据表
1999年6月
ORCA
2系列的FPGA
写地址（ WA [3： 0]）和写数据（WD [3:0 ] ）
也为了简化锁存由RAM时钟
的定时。从RAM读取数据进行异步
chronously ;因此，读地址（RA [3： 0]）是不
锁存。从读出操作的结果被放置在
LUT的输出端（F [3： 0]）。在F [3：0 ]输出数据可以
被路由出PFU的或发送给闩锁/ FF D [3 ：0]的
输入。
有使用该锁存器/ FFs的要结合两种方式
和灰的SSPM 。如果闩锁/ FF时钟的相位
和RAM时钟是一样的，只有一个读出地址
或写地址可被提供给RAM那
满足双方的同步定时要求
在RAM时钟和锁存/ FF时钟。因此，无论是
写入到RAM中或从RAM中读出可以做
在每个时钟周期，而不是两个。如果RAM时钟
从锁存器/ FF的时钟，那么这两个写倒
从RAM的RAM和一个读可以发生在每
时钟周期。这是通过增加一个外部写完成
地址/读地址多路转换器，如图
图15 。
的写地址上的时钟的相位提供
其允许安装到RAM时钟和读
地址是在时钟的相位供给该
允许读出的数据被设置到锁存器/ FF时钟。
如果一个较高速的RAM中是必需的，它允许两个一
读取和写入在每个时钟周期中，同步
双端口存储器模式（ SDPM ）都可以使用，因为它
不需要使用外部多路转换器。
可编程逻辑单元
（续）
同步存储器模式， SSPM和SDPM
在MA / MB内存异步模式说明
先前允许的PFU执行作为一个16× 4
（64位）的单端口RAM。同步写入到这个
RAM需要的写入使能控制信号为
在另一个PFU以创建一个写选通的时钟
脉搏。为了简化该功能，系列2的设备
包含
同步的单端口存储器
（ SSPM ）
模式，其中写脉冲的产生是做
在每个PFU 。
与SSPM模式下，整个LUT成为16 ×4
RAM中，如图14所示。在这种模式下，输入
端口写使能（ WE） ，写端口使能（ WPE ） ，
读/写地址（A [3： 0]） ，并且写入数据（WD [3:0 ]）。
同步写入RAM中，我们（输入A4）
和WPE （输入或者C0或CIN ）被锁存和
相与在一起。这与函数的结果被发送
到LUT中一个脉冲发生器，它写到RAM中
同步的向RAM时钟。这RAM时钟是
同一人送的PFU锁存/农民田间学校;然而，如有必要请
埃森，可以可编程地反转。
WE
A4
Q
写脉冲
发电机
HLUTA
WR
WPE
CIN ， C0
F3
Q
WA [3 ：0]的
RA [3：0 ]
WD [3：2 ]
F2
SSPM
写地址
阅读地址
1
0
WD
A
WE
WPE
D
Q
A[3:0]
A [ 3：0 ]，B [ 3：0]
Q
WD [3：0 ]的WD [3：0 ]
Q
HLUTB
WR
F1
RAM CLK
WA [3 ：0]的
RA [3：0 ]
WD [1：0 ]
F0
时钟
PFU
5-4644(F).r1
5-4642(F).r1
图15. SSPM每个时钟周期读取/写入
图14. SSPM模式， 16 ×4同步
单端口存储器
朗讯科技公司
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